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thc63lvdm83r/thc63lvdm63r_rev2.0
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thine electronics, 公司
thc63lvdm83r/thc63lvdm63r
减少 摆动 lvds 24bit/18bit 颜色 host-lcd 嵌板 接口
一般 描述
这 thc63lvdm83r 传输者 converts 28bits 的
cmos/ttl 数据 在 lvds (低 电压 差别的
signaling) 数据 stream. 一个 阶段-锁 transmit 时钟
是 transmitted 在 并行的 和 这 数据 streams 在 一个
fifth lvds link. 在 一个 transmit 时钟 频率 的
85mhz, 28bits 的 rgb 数据 和 4bits 的 lcd 定时
和 控制 数据 (hsync, vsync, cntl1, cntl2)
是 transmitted 在 一个 比率 的 595mbps 每 lvds 频道.
也 有 是 thc63lvdm63r 那 converts 21bits
的 cmos/ttl 数据 在 lvds(低 电压 differen-
tial signaling) 数据 stream. 两个都 传输者 能 是
编写程序 减少 摆动 lvds 通过 一个 专心致志的
管脚 为 低 电源 消耗量 和 emi.
特性
•
28:4 数据 频道 压缩 在 向上 至
298 megabytes 每 秒 throughput
•
宽 点 时钟 范围: 20-85mhz suited 为 vga,
svga, xga 和 sxga
•
narrow 总线 (10 线条 或者 8 线条) 减少 缆索 大小
•
支持 减少 摆动 lvds 为 低 emi
•
200mv 摆动 lvds/350mv 摆动 lvds
可选择的
•
支持 展开 spectrum 时钟 发生器
•
在 碎片 输入 jitter 过滤
•
pll 需要 非 外部 组件
•
单独的 3.3v 供应 和 125mw(典型值)
•
电源-向下 模式
•
低 profile 56 或者 48 含铅的 tssop 包装
•
时钟 边缘 可编程序的
•
改进 替换 为 这 国家的 ds90c383
或者 ds90c363
块 图解
ttl 并行的 至 串行
PLL
TA+/-
tb +/-
tc +/-
td +/-
tclk +/-
r/f
/pdwn
TA0-6
tc0-6
td0-6
传输者
(20 至 85mhz)
cmos/ttl
7
7
RS
7
tb0-6
7
输入
时钟
(lvds)
20-85mhz
数据
(lvds)
(140-595mbit/在 各自
lvds 频道)
时钟 在
ttl 并行的 至 串行
PLL
7
7
7
cmos/ttl
输入
TA0-6
tb0-6
tc0-6
传输者
(20 至 85mhz)
时钟 在
r/f
/pdwn
RS
TA+/-
tb +/-
tc +/-
tclk +/-
时钟
(lvds)
20-85mhz
(140-595mbit/在 各自
lvds 频道)
THC63LVDM83R
THC63LVDM63R
数据
(lvds)
4
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U
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