CDC509
3.3-v 锁相 回路 时钟 驾驶员
scas576b – july 1996 – 修订 january 1998
1
post 办公室 框 655303
•
达拉斯市, 德州 75265
d
锁相 回路 时钟 分布 用于
同步 dram 应用程序
d
分发 一个 时钟 输入 至 一个 银行 的
五个 和 一个 银行 的 四 产出
d
分开 输出 启用 用于 每个 输出
银行
d
外部 反馈 (fbin) 管脚 是 已使用 至
同步 这 产出 至 这 时钟 输入
d
否 外部 rc 网络 必填项
d
操作 在 3.3-v v
抄送
d
已打包 入点 塑料 24-管脚 薄 收缩
小轮廓 包装
描述
这 cdc509 是 一个 高-业绩, 低-偏斜, 低-抖动, 锁相 回路 (pll) 时钟 driver. 它 用途 一个 pll 至
精确地 对齐, 入点 两者都有 频率 和 相位, 这 反馈 (fbout) 输出 至 这 时钟 (clk) 输入 signal. 它
是 具体而言 设计 用于 使用 与 同步 drams. 这 cdc509 操作 在 3.3-v v
抄送
和 是 设计
至 驱动器 向上 至 五个 时钟 荷载 按 输出.
一个 银行 的 五个 产出 和 一个 银行 的 四 产出 提供 九 低-偏斜, 低抖动 副本 的 clk. 输出
信号 职责 循环次数 是 已调整 至 50 百分比, 独立 的 这 职责 循环 在 clk. 每个 银行 的 产出 可以
是 已启用 或 已禁用 单独 通过 这 控制 (1g 和 2g) 输入. 当 这 g 输入 是 高, 这 产出
开关 入点 相位 和 频率 与 clk; 当 这 g 输入 是 低, 这 产出 是 已禁用 至 这 逻辑-低
州.
不像 许多 产品 包含 plls, 这 cdc509 是否 不 需要 外部 rc 网络. 这 回路 过滤器 用于
这 pll 是 包括 开启-芯片, 最小化 组件 计数, 板 空间, 和 成本.
因为 它 是 基于 开启 pll 电路, 这 cdc509 需要 一个 稳定 时间 至 实现 相位 锁 的 这
反馈 信号 至 这 参考 信号. 这个 稳定 时间 是 必填项, 以下内容 电源 向上 和 应用程序
的 一个 固定-频率, 固定-相位 信号 在 clk, 作为 井 作为 以下内容 任何 变更 至 这 pll 参考 或
反馈 信号. 这 pll 可以 是 旁路 用于 测试一下 目的 由 捆扎带 av
抄送
至 接地.
这 cdc509 是 表征 用于 操作 从 0
°
c 至 70
°
c.
功能 表
输入
产出
1G 2G clk
1Y
(0:4)
2Y
(0:3)
FBOUT
x x l l l l
l LHLlh
l hhlhh
h LHHlh
h h h h h h
版权
1998, 德州 仪器仪表 股份公司
生产 数据 信息 是 电流 作为 的 出版物 日期.
产品 符合 至 规格 按 这 条款 的 德州 仪器仪表
标准 保修. 生产 加工 是否 不 必然 包括
测试 的 全部 参数.
请 是 意识到 那 一个 重要 通知 关于 可用性, 标准 保修, 和 使用 入点 关键 应用程序 的
德州 仪器仪表 半导体 产品 和 免责声明 对此 出现 在 这 结束 的 这个 数据 工作表.
clk
av
抄送
v
抄送
2Y0
2Y1
地
地
2Y2
2Y3
v
抄送
2G
FBIN
1
2
3
4
5
6
7
8
9
10
11
12
AGND
v
抄送
1Y0
1Y1
1Y2
地
地
1Y3
1Y4
v
抄送
1G
FBOUT
24
23
22
21
20
19
18
17
16
15
14
13
pw 包装
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