october 1995 1/8
st 486 dx asic 核心
全部地 静态的 3.3v 486 dx/dx2/dx4 asic 核心
初步的 数据
■
全部地 静态的 486 兼容 核心 能 至
运作 从 d.c 至 120mhz
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制造的 在 一个 0.35 micron five layer
metal hcmos 处理
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8k 字节 unified 操作指南 和 数据 cache
和 写 后面的 能力
■
并行的 处理 integral floating 要点 单位,
和 自动 电源 向下 模式
■
低 电源 系统 管理 modes
■
cell libraries 为 2.2v 和 3.3v 供应 和
5 v i/o 接口 能力
■
2 - 输入 与非 延迟 的 0.160 ns (典型值) 和
输出 = 2.
■
broad i/o 符合实际 包含 lvcmos,
lvttl, gtl, pecl, 和 lvds.
■
高 驱动 i/o; capability 的 sinking 向上 至 48
毫安 和 回转 比率 控制, 电流 尖刺 sup-
pression 和 阻抗 相一致.
■
发生器 至 支持 spram, dpram,
只读存储器 和 许多 其它 embedded 功能.
■
全部地 独立 电源 和 地面 configu-
rations 为 输入, 核心 和 输出.
■
可编程序的 i/o 环绕 能力 向上 至 1000
焊盘.
■
输出 缓存区 有能力 的 驱动 isa, eisa,
pci, mca, 和 scsi 接口 水平.
■
起作用的 拉 向上 和 拉 向下 设备.
■
buskeeper i/o 功能.
■
oscillators 为 宽 频率 spectrum.
■
broad 范围 的 400 ssi cells.
■
设计 为 测试 包含 lssd macro 库
选项 和 ieee 1149.1 jtag boundary
scan architecture 建造 在.
■
cadence 为基础 设计 系统 和 inter-
faces 从 多样的 workstations.
■
broad 陶瓷的 和 塑料 包装 范围.
■
latchup 触发 电流 > +/- 500 毫安.
静电释放 保护 > +/- 4000 伏特.
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sea 的 gates
Standard cells
C美国tom i/o
Prog内存m 能
i/o
e.g 内存DAC
SVG一个
chipset / pci
IDE/ 是一个
486 dx coRE
只读存储器
内存
DPRAM
图示 1. 例子 486 dx 核心 asic
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