综合
电路
系统, 公司
ics9250-25
第三 派对 品牌 和 姓名 是 这 财产 的 他们的 各自 业主.
块 图表
9250-25 rev 一个 10/03/00
管脚 配置
推荐 应用程序:
• 2 - cpus @ 2.5v, 向上 至 153.33mhz.
• 13 - sdram @ 3.3v, 向上 至 153.33mhz.
• 3 - 3v66 @ 3.3v, 2x pci mhz.
• 8 - pci @3.3v.
• 1 - 48mhz, @3.3v 固定.
• 1 - 24mhz @ 3.3v
• 1 - 参考 @3.3v, 14.318mhz.
特点:
• 向上 至 153.33mhz 频率 支持
• 支持 电源 管理 通过 pd#.
• 传播 光谱 用于 emi 控制 (± 0.25%)
中心 传播.
• 用途 外部 14.318mhz 水晶
• fs 针脚 用于 频率 选择
钥匙 规格:
• cpu 输出 抖动: &指示灯;250ps
• ioapic 输出 抖动: &指示灯;500ps
• 48mhz, 3v66, pci 输出 抖动: &指示灯;500ps
• 参考 输出 抖动. &指示灯;1000ps
• cpu 输出 偏斜: &指示灯;175ps
• pci 输出 偏斜: &指示灯;500ps
• 3v66 输出 偏斜 &指示灯;175ps
• 用于 集团 偏斜 计时, 请 参考 至 这
集团 计时 关系 表.
频率 发电机 &放大器; 综合 缓冲区 用于 celeron &放大器; p
二
/
三
™
56-管脚 300 密耳 ssop
s data
SCLK
PLL2
PLL1
传播
光谱
48MHz
24MHz
cpuclk [1:0]
2
12
8
3
sdram [11:0]
IOAPIC
pciclk [7:0]
sdram_f
3v66 [2:0]
X1
X2
XTAL
osc
CPU
DIVDER
SDRAM
DIVDER
IOAPIC
DIVDER
PCI
DIVDER
3V66
DIVDER
fs[4:0]
PD#
控制
逻辑
配置.
注册.
/ 2
REF0
VDDREF
X1
X2
GNDREF
GND3V66
3v66-1
3v66-2
VDD3V66
VDDPCI
*fs0/pciclk0
*fs1/pciclk1
PCICLK2
GNDPCI
PCICLK3
PCICLK4
PCICLK5
VDDPCI
PCICLK6
PCICLK7
GNDPCI
PD#
SCLK
s data
VDDSDR
SDRAM11
SDRAM10
GNDSDR
3v66-0
1
1
ref0/fs4*
VDDLAPIC
IOAPIC
VDDLCPU
CPUCLK0
CPUCLK1
GNDLCPU
GNDSDR
SDRAM0
SDRAM1
SDRAM2
VDDSDR
SDRAM3
SDRAM4
SDRAM5
GNDSDR
SDRAM6
SDRAM7
sdram_f
VDDSDR
GND48
24mhz/fs2*
48mhz/fs3*
VDD48
VDDSDR
SDRAM8
SDRAM9
GNDSDR
1
1
ics9250-25
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
26
27
28
56
55
54
53
52
51
50
49
48
47
46
45
44
43
42
41
40
39
38
37
36
35
34
33
32
31
30
29
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