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资料编号:1117230
 
资料名称:CD74HCT112
 
文件大小: 368K
   
说明
 
介绍:
High Speed CMOS Logic Dual Negative-Edge-Triggered J-K Flip-Flops with Set and Reset
 
 


: 点此下载
 
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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
1
数据 工作表 获得 从 harris 半导体
SCHS141H
特点
滞后 开启 时钟 输入 用于 改进 噪声
免疫 和 增加 输入 上升 和 坠落 次
异步 设置 和 重置
互补 产出
缓冲 输入
典型 f
最大值
= 60mhz 在 v
抄送
= 5v, c
l
= 15pf,
t
一个
= 25
o
c
扇出 (结束 温度 范围)
- 标准 产出 . . . . . . . . . . . . . . . 10 lsttl 荷载
- 总线 驾驶员 产出 . . . . . . . . . . . . . 15 lsttl 荷载
宽 操作 温度 范围 . . . -55
o
c 至 125
o
c
平衡式 传播 延迟 和 过渡 次
Signi 电源 减少 比较 至 lsttl
逻辑 ics
hc 类型
- 2v 至 6v 操作
- 高 噪声 免疫: n
il
= 30%, n
ih
= 30% 的 v
抄送
在 v
抄送
= 5v
hct 类型
- 4.5v 至 5.5v 操作
- 直接 lsttl 输入 逻辑 兼容性,
v
il
= 0.8v (最大值), v
ih
= 2v (最小)
- cmos 输入 兼容性, 我
l
1
µ
一个 在 v
ol
, v
引出线
cd54hc112, cd54hct112 (cerdip)
cd74hc112 (pdip, soic, sop, tssop)
cd74hct112 (pdip)
顶部 查看
描述
’HC112 ’HCT112 利用 硅栅 CMOS
技术 实现 操作 速度 等效 LSTTL
零件. 他们 展品 电源 消费 标准
CMOS 综合 电路, 一起 能力 驱动器 10
lsttl 荷载.
这些 独立 j, k, 设置, 重置,
时钟 输入 q
q 产出. 他们 变更 开启
负向 过渡 时钟 脉冲. 设置 重置
是 已完成 异步 由 低水平 输入.
HCT 逻辑 家庭 功能上 作为 作为 管脚-
兼容 与 这 标准 ls 逻辑 家庭.
.
14
15
16
9
13
12
11
10
1
2
3
4
5
7
6
8
1CP
1K
1J
1S
1Q
1Q
2Q
v
抄送
2R
2CP
2K
2J
2S
2Q
1R
订购 信息
零件 号码
温度 范围
(
o
c) 包装
CD54HC112F3A -55 至 125 16 ld cerdip
CD54HCT112F3A -55 至 125 16 ld cerdip
CD74HC112E -55 至 125 16 ld pdip
CD74HC112MT -55 至 125 16 ld soic
CD74HC112M96 -55 至 125 16 ld soic
CD74HC112NSR -55 至 125 16 ld sop
CD74HC112PW -55 至 125 16 ld tssop
CD74HC112PWR -55 至 125 16 ld tssop
CD74HC112PWT -55 至 125 16 ld tssop
CD74HCT112E -55 至 125 16 ld pdip
备注: 订购, 使用 整个 零件 号码. suffixes 96
表示 胶带 卷轴. suffix t 表示 一个 小批量
卷轴 的 250.
注意事项: 这些 设备 是 敏感 至 静电 放电. 用户 应该 跟着 适当的 集成电路 搬运 程序.
版权
©
2003, 德州 仪器仪表 股份公司
cd54hc112, cd74hc112,
cd54hct112, cd74hct112
双 j-k 触发器 与 设置 和 重置
负-边缘 触发器
[ /标题
(cd74
HC112
,
c
D74
HCT11
2)
/sub-
项目
(双
j-k
翻转-
翻牌圈
设置
重置
nega-
march 1998 - 修订 october 2003
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