CDC2582
3.3-v 锁相 回路 时钟 驾驶员
与 差速器 lvpecl 时钟 输入
scas379b – 二月 1993 – 修订 二月 1996
1
post 办公室 框 655303
•
达拉斯市, 德州 75265
d
低 输出 偏斜 用于 时钟-分布
和 时钟生成 应用程序
d
操作 在 3.3-v v
抄送
d
分发 差速器 lvpecl 时钟
输入 至 12 ttl-兼容 产出
d
两个 选择 输入 配置 向上 至 九
产出 至 操作 在 一半 或 双
这 输入 频率
d
否 外部 rc 网络 必填项
d
外部 反馈 输入 (fbin) 是 已使用 至
同步 这 产出 与 这 时钟
输入
d
应用程序 用于 同步 drams
d
产出 有 内部 26-
Ω
系列
电阻 至 阻尼 传输线
效果
d
最先进的
epic-
ΙΙ
B
bicmos 设计
显著 减少 电源 耗散
d
分布式 v
抄送
和 接地 针脚 减少
开关 噪声
d
已打包 入点 52-管脚 四边形 扁平包装
pah 包装
(顶部 查看)
15 16
v
抄送
4Y3
地
v
抄送
4Y2
地
v
抄送
4Y1
地
地
v
抄送
3Y3
地
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1Y1
v
抄送
地
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抄送
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1Y3
v
抄送
地
地
2Y1
v
抄送
18 19 20 21
CLKIN
CLKIN
一个
oe
51 50 49 48 4752 46
地
SEL1
SEL0
AGND
FBIN
AGND
v
地
3Y2
v
地
2Y3
地
地
3Y1
44 43 4245
22 23 24 25 26
41 40
14
地
2Y2
测试一下
clr
抄送
抄送
v
抄送
v
抄送
v
抄送
一个
v
抄送
描述
这 cdc2582 是 一个 高-业绩, 低-偏斜, 低抖动 时钟 驾驶员. 它 用途 一个 锁相 回路 (pll) 至
精确地 对齐 这 频率 和 相位 的 这 时钟 输出 信号 至 这 差速器 lvpecl 时钟 (clkin,
CLKIN
) 输入 信号. 它 是 具体而言 设计 至 操作 在 速度 从 50 mhz 至 100 mhz 或 向下 至 25 mhz
开启 产出 已配置 作为 半频 产出. 每个 输出 有 一个 内部 26-
Ω
系列 电阻 那 改进
这 信号 完整性 在 这 荷载. 这 cdc2582 操作 在 3.3-v v
抄送
.
这 反馈 输入 (fbin) 同步 这 频率 的 这 输出 时钟 与 这 输入 时钟 (clkin, clkin)
信号. 一个 的 这 十二 输出 时钟 必须 是 美联储 背面 至 fbin 用于 这 pll 至 维护 同步
之间 这 差速器 clkin 和 clkin
输入 和 这 产出. 这 输出 已使用 作为 反馈 是 已同步
至 这 相同 频率 作为 这 时钟 (clkin 和 clkin) 输入.
版权
1996, 德州 仪器仪表 股份公司
生产 数据 信息 是 电流 作为 的 出版物 日期.
产品 符合 至 规格 按 这 条款 的 德州 仪器仪表
标准 保修. 生产 加工 是否 不 必然 包括
测试 的 全部 参数.
epic-
ΙΙ
b 是 一个 商标 的 德州 仪器仪表 股份公司.
请 是 意识到 那 一个 重要 通知 关于 可用性, 标准 保修, 和 使用 入点 关键 应用程序 的
德州 仪器仪表 半导体 产品 和 免责声明 对此 出现 在 这 结束 的 这个 数据 工作表.
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