1k x 8 双端口 静态 ram
传真 id: 5200
cy7c130/cy7c131
cy7c140/cy7c141
柏树 半导体 公司
• 3901 北 第一 街道 • San Jose • ca 95134 • 408-943-2600
将 1989 – 修订 march 27, 1997
1cy 7 c14 0
特点
• 真 双端口 记忆 细胞 哪个 允许 simulta-
neous 右eads 的 这 相同 memory 位置
• 1k x 8 组织机构
• 0.65-微米 cmos 用于 最佳 速度/电源
• 高速 访问权限: 15 ns
• 低 操作 电源: 我
抄送
= 90 ma (最大值.)
• 完全 异步 操作
• 自动 电源-向下
• 主人 cy7c130/cy7c131 很容易 展开 数据 总线
宽度 至 16 或 更多 比特 使用 奴隶cy7c140/cy7c141
• 忙
输出 旗子 开启 cy7c130/cy7c131; 忙输入
开启 cy7c140/cy7c141
• 智力
旗子 用于 港口-至-港口 通信
• 可用 入点 48-管脚 倾角 (cy7c130/140), 52-管脚 plcc 和
52-管脚 tqfp
• 引脚兼容 和 功能上 等效 至
idt7130/idt7140
功能 描述
这 cy7c130/cy7c131/cy7c140 和 cy7c141 是
高速 cmos 1k 由 8 双端口 静态 rams. 两个 端口
是 提供 允许 独立访问权限 至 任何位置 入点
记忆. 这 cy7c130/ cy7c131 可以 是 已利用 作为 either 一个
独立 8-有点 双端口 静态 ram 或 作为 一个 主人 双端口
ram 入点 连接词 与 这 cy7c140/cy7c141 奴隶 du-
铝-港口 设备 入点 系统 要求 16-有点 或 更大 字
宽度. 它 是 这 解决方案 至 应用程序 要求 共享 或
缓冲 数据, 这样的 作为高速缓存记忆 用于 dsp, 有点-切片, 或
multipro处理器 设计.
每个 港口 有 独立 控制rol 针脚; 芯片 启用 (ce
),
写启用 (右/w
), 和 输出 启用 (oe). 两个 旗帜 是
提供 开启 每个 港口, 忙
和 智力. 忙信号 那 这
港口 是 正在尝试 至访问权限这 相同 位置 目前 正在 交流电-
已加工 由这 其他 港口. 智力
是 一个 中断 旗子 指示 那
数据 有 被 已放置 入点 一个 独一无二 位置 (3ff 用于 这左 港口
和 3fe 用于 这 右侧 港口). 一个 自动 电源-向下 功能
是 受控 指示ependently 开启 每个 港口 由这 芯片 启用
(ce
) 针脚.
这 cy7c130 和 cy7c140 是 可用 入点 48-管脚 倾角. 这
cy7c131 和 cy7c141 是 可用 入点 52-管脚 plcc 和
pqfp.
s
备注:
1. cy7c130/cy7c131 (主人): 忙
是 打开 排水管 输出 和 需要 上拉 电阻
cy7c140/cy7c141 (奴隶): 忙是 输入.
2. 打开 排水管 产出: 拉-向上 电阻 必填项
逻辑 块 图表
管脚 配置
c130-1
c130-2
13
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15
16
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18
19
20
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22
23 26
27
28
32
31
30
29
33
36
35
34
24 25
地
1
2
3
4
5
6
7
8
9
10
11
38
39
40
44
43
42
41
45
48
47
46
12 37
右/w
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ce
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忙
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智力
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一个
0L
一个
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倾角
顶部 查看
7C130
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忙
右
智力
l
智力
右
仲裁
逻辑
(7c130/7c131 仅)
和
中断 逻辑
控制
我/o
控制
我/o
记忆
阵列
地址
解码器
地址
解码器
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