HS4-3282-8_集成电路资料查询网

5-183
涉及 an400
march 1997
hs-3282
cmos arinc 总线 接口 电路
特性
• arlnc 规格 429 兼容
• 数据 比率 的 100 kilobits 或者 12.5 kilobits
• 独立的 接受者 和 传输者 部分
• 双 和 独立 接受者, 连接 直接地
至 arinc 总线
• 串行 至 并行的 接受者 数据 转换
• 并行的 至 串行 传输者 数据 转换
• 文字 长度 的 25 或者 32 位
• parity 状态 的 received 数据
• 发生 parity 的 传输者 数据
• 自动 文字 间隙 计时器
• 单独的 5v 供应
• 低 电源 消耗
• 全部 军队 温度 范围
描述
这 hs-3282 是 一个 高 效能 cmos 总线 接口
电路 那 是 将 至 满足 这 (所需的)东西 的 arinc
规格 429, 和 类似的 encoded, 时间 多路复用
串行 数据 protocols. 这个 设备 是 将 至 是 使用 和
这 hs-3182, 一个 大而单一的 dl 双极 差别的 线条 驱动器
设计 至 满足 这 speciﬁcations 的 arinc 429. 这
arinc 429 总线 接口 电路 组成 的 二 (2) 接受者
和 一个 传输者 运行 independently 作 显示 在
图示 1. 这 二 接受者 运作 在 一个 频率 那 是 ten
(10) 时间 这 接受者 数据 比率, 这个 能 是 这 一样 或者
不同的 从 这 传输者 数据 比率. 虽然 这 二
接受者 运作 在 这 一样 频率, 它们 是
functionally 独立 和 各自 receives 串行 数据 asyn-
chronously. 这 传输者 部分 的 这 arinc 总线
接口 电路 组成 mainly 的 一个 第一-在 第一-输出 (先进先出)
记忆 和 定时 电路. 这 先进先出 记忆 是 使用 至 支撑
向上 至 第八 (8) arinc 数据 words 为 传递 serially.
这 定时 电路 是 使用 至 correctly 独立的 各自 arinc
文字 作 必需的 用 arinc 规格 429. 甚至 though
arinc 规格 429 speciﬁes 一个 32-位 文字, 包含
parity, 这 hs-3282 能 是 编写程序 至 也 运作 和
一个 文字 长度 的 25 位. 这 新当选的 接受者 数据 文字
parity 是 审查, 和 一个 parity 状态 是 贮存 在 这 接受者
获得 和 输出 在 管脚 bd08 在 这 1st 文字. [a 逻辑
“0” indicates 那 一个 odd 号码 的 逻辑 “1” s 是 received
和 贮存; 一个 逻辑 “1” indicates 那 一个 甚至 号码 的 逻辑
“1”s 是 received 和 stored]. 在 这 传输者 这 parity
发生器 将 发生 也 odd 或者 甚至 parity 取决于
在之上 这 状态 的 parck 控制 信号. 一个 逻辑 “0” 在 bd12
将 导致 odd parity 至 是 使用 在 这 输出 数据 stream.
versatility 是 提供 在 两个都 这 传输者 和 接受者 用
这 外部 时钟 输入 这个 准许 这 总线 接口 电路
至 运作 在 数据 比率 从 0 至 100 kilobits. 这 外部
时钟 必须 是 ten (10) 时间 这 数据 比率 至 insure 非 数据
ambiguity.
这 arinc 总线 接口 电路 是 全部地 有保证的 至
支持 这 数据 比率 的 arinc 规格 429 在 两个都
这 电压 (
±
5%) 和 全部 军队 温度 范围. 它
接口 和 ul, cmos 或者 nmos 支持 电路系统, 和
使用 这 标准 5-volt v
CC
供应.
订货 信息
包装 温度 范围 部分 号码
pkg.
非.
CERDIP -55
o
c 至 +125
o
C hs1-3282-8 f40.6
SMD# 5962-8688001qa f40.6
CLCC -40
o
c 至 +85
o
C hs4-3282-9+ j44.一个
-55
o
c 至 +125
o
C hs4-3282-8 j44.一个
SMD# 5962-8688001xa j44.一个
文件 号码
2964.2
提醒: 这些 设备 是 敏感的 至 静电的 释放; follow 恰当的 ic 处理 程序.
http://www.intersil.com 或者 407-727-9207
|
版权
©
intersil 公司 1999

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5-183 涉及 an400 march 1997 hs-3282 cmos arinc 总线接口电路特性 • arlnc 规格 429 兼容 • 数据比率的 100 kilobits 或者 12.5 kilobits • 独立的接受者和传输者部分 • 双和独立接受者, 连接直接地至 arinc 总线 • 串行至并行的接受者数据转换 • 并行的至串行传输者数据转换 • 文字长度的 25 或者 32 位 • parity 状态的 received 数据 • 发生 parity 的传输者数据 • 自动文字间隙计时器 • 单独的 5v 供应 • 低电源消耗 • 全部军队温度范围描述这 hs-3282 是一个高效能 cmos 总线接口电路那是将至满足这 (所需的)东西的 arinc 规格 429, 和类似的 encoded, 时间多路复用串行数据 protocols. 这个设备是将至是使用和这 hs-3182, 一个大而单一的 dl 双极差别的线条驱动器设计至满足这 speciﬁcations 的 arinc 429. 这 arinc 429 总线接口电路组成的二 (2) 接受者和一个传输者运行 independently 作显示在图示 1. 这二接受者运作在一个频率那是 ten (10) 时间这接受者数据比率, 这个能是这一样或者不同的从这传输者数据比率. 虽然这二接受者运作在这一样频率, 它们是 functionally 独立和各自 receives 串行数据 asyn- chronously. 这传输者部分的这 arinc 总线接口电路组成 mainly 的一个第一-在第一-输出 (先进先出) 记忆和定时电路. 这先进先出记忆是使用至支撑向上至第八 (8) arinc 数据 words 为传递 serially. 这定时电路是使用至 correctly 独立的各自 arinc 文字作必需的用 arinc 规格 429. 甚至 though arinc 规格 429 speciﬁes 一个 32-位文字, 包含 parity, 这 hs-3282 能是编写程序至也运作和一个文字长度的 25 位. 这新当选的接受者数据文字 parity 是审查, 和一个 parity 状态是贮存在这接受者获得和输出在管脚 bd08 在这 1st 文字. [a 逻辑 “0” indicates 那一个 odd 号码的逻辑 “1” s 是 received 和贮存; 一个逻辑 “1” indicates 那一个甚至号码的逻辑 “1”s 是 received 和 stored]. 在这传输者这 parity 发生器将发生也 odd 或者甚至 parity 取决于在之上这状态的 parck 控制信号. 一个逻辑 “0” 在 bd12 将导致 odd parity 至是使用在这输出数据 stream. versatility 是提供在两个都这传输者和接受者用这外部时钟输入这个准许这总线接口电路至运作在数据比率从 0 至 100 kilobits. 这外部时钟必须是 ten (10) 时间这数据比率至 insure 非数据 ambiguity. 这 arinc 总线接口电路是全部地有保证的至支持这数据比率的 arinc 规格 429 在两个都这电压 ( ± 5%) 和全部军队温度范围. 它接口和 ul, cmos 或者 nmos 支持电路系统, 和使用这标准 5-volt v CC 供应. 订货信息包装温度范围部分号码 pkg. 非. CERDIP -55 o c 至 +125 o C hs1-3282-8 f40.6 SMD# 5962-8688001qa f40.6 CLCC -40 o c 至 +85 o C hs4-3282-9+ j44.一个 -55 o c 至 +125 o C hs4-3282-8 j44.一个 SMD# 5962-8688001xa j44.一个文件号码 2964.2 提醒: 这些设备是敏感的至静电的释放; follow 恰当的 ic 处理程序. http://www.intersil.com 或者 407-727-9207 \| 版权 © intersil 公司 1999

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