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资料编号:78127
 
资料名称:ispLSI2064E-100LT100
 
文件大小: 142.37K
   
说明
 
介绍:
In-System Programmable SuperFAST⑩ High Density PLD
 
 


: 点此下载
 
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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
ispLSI
®
2064E
在系统内 可编程
superfast™ 高 密度 pld
2064e_05
1
描述
这 isplsi 2064e 是 一个 高 密度 可编程 逻辑
设备. 这 设备 包含 64 寄存器, 64 通用
我/o 针脚, 四 专用 输入 针脚, 三个 专用
时钟 输入 针脚, 两个 专用 全球 oe 输入 针脚 和
一个 全球 路由 游泳池 (grp). 这 grp 提供 com-
完整 interconnectivity 之间 全部 的 这些 元素.
国家 和 在系统内 诊断 能力. 这 isplsi
2064e 优惠 非挥发性 可重新编程性 的 这 逻辑,
作为 井 作为 这 互连 至 提供 真的 可重构
系统.
这 基本 单位 的 逻辑 开启 这 isplsi 2064e 设备 是 这
通用 逻辑 块 (glb). 这 glbs 是 已标记 a0, a1
.. b7 (请参见 图 1). 那里 是 一个 合计 的 16 glbs 入点 这
isplsi 2064e 设备. 每个 glb 是 制造 向上 的 四
宏单元. 每个 glb 有 18 输入, 一个 可编程
和/或/独占 或 阵列, 和 四 产出 哪个 可以
是 已配置 至 是 要么 组合 或 已注册.
输入 至 这 glb 来 从 这 grp 和 专用
输入. 全部 的 这 glb 产出 是 带来了 背面 进入 这
grp 所以 那 他们 可以 是 已连接 至 这 输入 的 任何
glb 开启 这 设备.
功能 块 图表
版权 © 1999 lattice 半导体 corp. 全部 品牌 或 产品 姓名 是 商标 或 已注册 商标 的 他们的 各自 持有人. 这 规格 和 信息 此处 是 主题
至 变更 无 通知.
lattice 半导体 corp., 5555 northeast moore ct., hillsboro, oregon 97124, 美国
电话. (503) 268-8000; 1-800-lattice; 传真 (503) 268-8556; http://www.latticesemi.com
六月 2000
特点
superfast 高 密度 在系统内
可编程 逻辑
2000 pld 盖茨
64 我/o 针脚, 四 专用 输入
64 寄存器
高 速度 全球 互连
宽 输入 浇口 用于 快 计数器, 州
机器, 地址 解码器, 等
小 逻辑 块 尺寸 用于 随机 逻辑
100% 功能上 和 电子元件工业联合会 向上 兼容
与 isplsi 2064 设备
高 业绩 e?
2
CMOS
®
技术
f
最大值
= 200 mhz 最大值 操作 频率
t
pd
= 4.5 ns 传播 延迟
ttl 兼容 输入 和 产出
5v 可编程 逻辑 核心
ispjtag™ 在系统内 可编程 通过 ieee 1149.1
(jtag) 测试一下 访问权限 港口
用户可选择 3.3v 或 5v 我/o 支架 混合
电压 系统
pci 兼容 产出
开漏极 输出 选项
电气 可擦除 和 可重新编程
非挥发性
未使用 产品 期限 停机 保存 电源
isplsi 优惠 这 以下内容 已添加 特点
增加 制造业 收益率, 减少 时间-至-
市场 和 改进 产品 质量
重新编程 焊接 设备 用于 更快 原型设计
优惠 这 轻松 的 使用 和 快 系统
速度 的 plds 与 这 密度 和 灵活性
的 字段 可编程 闸门 阵列
完成 可编程 设备 可以 联合收割机 胶水
逻辑 和 结构化 设计
增强型 管脚 锁定 能力
三个 专用 时钟 输入 针脚
同步 和 异步 时钟
可编程 输出 回转 费率 控制 至
最小化 开关 噪声
灵活 管脚 放置位置
优化 全球 路由 游泳池 提供 全球
Interconnectivity
ispdesignexpert™ – 逻辑 编译器 和 com-
完整 isp 设备 设计 系统 从 hdl
合成 通过 在系统内 编程
上级 质量 的 结果
紧紧地 综合 与 领先 cae 供应商 工具
productivity 增强 计时 分析仪, explore
工具, 计时 模拟器 和 ispanalyzer™
pc 和 unix platforms
全球 路由 游泳池
(grp)
A0
A1
A3
输入 总线
输出 路由 游泳池 (orp)
B3
B2
B1
B0
输入 总线
输出 路由 游泳池 (orp)
A2
GLB
逻辑
阵列
DQ
DQ
DQ
DQ
A4
A5
A6 A7
输入 总线
输出 路由 游泳池 (orp)
B7
B6 B5 B4
输入 总线
输出 路由 游泳池 (orp)
0139/2064e
B7 B6 B5 B4
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