MM54HC42N_集成电路资料查询网

TLF5301
MM54HC42MM74HC42 bcd-至-decimal 解码器
January 1988
MM54HC42MM74HC42
bcd-至-decimal 解码器
一般 描述
这个 解码器 运用 先进的 硅-门 CMOS technol-
ogy 数据 在 这 四 输入 管脚 选择 一个 的 这 10 输出
相应的 至 这 值 的 这 BCD 号码 在 这 在-
puts 一个 输出 将 go 低 当 selected 否则 它 re-
mains high 如果 这 输入 数据 是 不 一个 有效的 BCD 号码 所有
输出 将 仍然是 high 这 电路 有 高 噪音 免除
和 低 电源 消耗量 通常地 有关联的 和 CMOS
circuitry 还 也 有 speeds comparable 至 低 电源
肖特基 TTL (ls-ttl) circuits 和 是 有能力 的 驱动 10
ls-ttl 相等的 loads
所有 输入 是 保护 从 损坏 预定的 至 静态的 dis-
承担 用 二极管 至 V
CC
和 ground
特性
Y
典型 传播 delay 15 ns
Y
宽 供应 range 2V–6V
Y
低 安静的 current 80
m
一个 (74hc)
Y
输出 的 10 ls-ttl 负载
连接 图解
双-在-线条 包装
TLF5301–1
顶 视图
顺序 号码 MM54HC42 或者 MM74HC42
真实 表格
No
输入 输出
DCBA0123456789
 LLLLLHHHHHHHHH
 L L LHHLHHHHHHHH
 LLHLHHLHHHHHHH
 L LHHHHHLHHHHHH
 LHL LHHHHLHHHHH
 LHLHHHHHHLHHHH
 LHHLHHHHHHLHHH
 LHHHHHHHHHHLHH
 HL L LHHHHHHHHLH
 HL LHHHHHHHHHHL
HLHLHHHHHHHHHH
HLHHHHHHHHHHHH
INVALID
HHL LHHHHHHHHHH
HHLHHHHHHHHHHH
HHHLHHHHHHHHHH
HHHHHHHHHHHHHH
H
e
高 Level L
e
低 水平的
逻辑 图解
TLF5301–2
C
1995 国家的 半导体 公司 rrd-b30m105printed 在 U S A

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TLF5301 MM54HC42MM74HC42 bcd-至-decimal 解码器 January 1988 MM54HC42MM74HC42 bcd-至-decimal 解码器一般描述这个解码器运用先进的硅-门 CMOS technol- ogy 数据在这四输入管脚选择一个的这 10 输出相应的至这值的这 BCD 号码在这在- puts 一个输出将 go 低当 selected 否则它 re- mains high 如果这输入数据是不一个有效的 BCD 号码所有输出将仍然是 high 这电路有高噪音免除和低电源消耗量通常地有关联的和 CMOS circuitry 还也有 speeds comparable 至低电源肖特基 TTL (ls-ttl) circuits 和是有能力的驱动 10 ls-ttl 相等的 loads 所有输入是保护从损坏预定的至静态的 dis- 承担用二极管至 V CC 和 ground 特性 Y 典型传播 delay 15 ns Y 宽供应 range 2V–6V Y 低安静的 current 80 m 一个 (74hc) Y 输出的 10 ls-ttl 负载连接图解双-在-线条包装 TLF5301–1 顶视图顺序号码 MM54HC42 或者 MM74HC42 真实表格 No 输入输出 DCBA0123456789  LLLLLHHHHHHHHH  L L LHHLHHHHHHHH  LLHLHHLHHHHHHH  L LHHHHHLHHHHHH  LHL LHHHHLHHHHH  LHLHHHHHHLHHHH  LHHLHHHHHHLHHH  LHHHHHHHHHHLHH  HL L LHHHHHHHHLH  HL LHHHHHHHHHHL HLHLHHHHHHHHHH HLHHHHHHHHHHHH INVALID HHL LHHHHHHHHHH HHLHHHHHHHHHHH HHHLHHHHHHHHHH HHHHHHHHHHHHHH H e 高 Level L e 低水平的逻辑图解 TLF5301–2 C 1995 国家的半导体公司 rrd-b30m105printed 在 U S A

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