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资料编号:668343
资料名称:
U62256ADK07LL
文件大小: 164.41K
说明
:
介绍
:
STANDARD 32K X 8 SRAM
: 点此下载
1
2
3
4
5
6
7
8
9
本平台电子爱好着纯手工中文简译:
截至2020/5/17日,支持英文词汇500个
U62256A
april 20, 2004
1 1
!
32768x8 位 静态的 cmos 内存
!
进入 时间 70 ns, 100 ns
!
一般 数据 输入 和
数据 输出
!
三-状态
输出
!
典型值 运行 供应 电流
70 ns: 50 毫安
100 ns: 40 毫安
!
ttl/cmos-兼容
!
automatical 减少 的 电源
消耗 在 长 读 循环
!
电源 供应 电压 5 v
+
10 %
!
运行 温度 范围
0
至
70 °c
-40
至
85 °c
-40
至
125 °c
!
qs 9000 质量 标准
!
静电释放 保护 > 2000 v
(mil 标准 883c m3015.7)
!
获得-向上 免除 >100 毫安
!
包装:
pdip28 (600 mil)
sop28 (330 mil)
标准 32k x 8 sram
特性
这 u62256a 是 一个 静态的 内存
制造的 使用 一个 cmos pro-
cess 技术 和 这 下列的
运行 模式:
- 读
- 备用物品
- 写
- 数据 保持
这 记忆 排列 是 为基础 在 一个
6-晶体管 cell.
这 电路 是 使活动 用 这 fal-
ling 边缘 的 e
. 这 地址 和
控制 输入 打开 同时发生地.
符合 至 这 信息 的 w
和 g
, 这 数据 输入, 或者 输出,
是 起作用的. 在 一个 读 循环, 这
数据 输出 是 使活动 用 这
下落 边缘 的 g
, afterwards 这
数据 文字 读 将 是 有 在
这 输出 dq0-dq7. 之后 这
地址 改变, 这 数据 输出
go 高-z 直到 这 新 信息
读 是 有. 这 数据 输出
有 不 preferred 状态.
这 读 循环 是 finished 用 这
下落 边缘 的 w
, 或者 用 这 rising
边缘 的 e
, 各自.
数据 保持 是 有保证的 向下
至 2 v. 和 这 例外 的 e
, 所有
输入 组成 的 也不 门, 所以
那 非 拉-向上/拉-向下 电阻器
是 必需的.
描述
管脚 配置
1
A14
VCC
28
2
A12
W
27
4
A6
A8
25
5
A5
A9
24
3
A7
A13
26
6
A4
A11
23
7
A3
G
22
8
A2
A10
21
12
DQ1
DQ5
17
9
A1
E
20
10
A0
DQ7
19
11
DQ0
DQ6
18
13
DQ2
DQ4
16
14
VSS
DQ3
15
顶 视图
信号 名字
信号 描述
a0 - a14
地址 输入
dq0 - dq7
数据 在/输出
E
碎片 使能
G
输出 使能
W
写 使能
VCC
电源 供应 电压
VSS
地面
管脚 描述
PDIP
SOP
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