ds092 (v1.0) 12月 19, 2001
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进步 产品 规格
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所有 其它 商标 和 注册 商标 是 这 所有物 的 它们的 各自的 所有权人. 所有 规格 是 主题 至 change 没有 注意.
特性
• industries 最好的 0.18 micron cmos cpld
- 4.0 ns 管脚-至-管脚 逻辑 延迟
- 较少 比 100
µ
一个 备用物品 电流 消耗量
- 64 macrocells 和 向上 至 1,600 逻辑 门
- 快 输入 寄存器
- 回转 比率 控制 在 单独的 输出
- lvcmos 1.8v 通过 3.3v
-lvttl 3.3v
• 有 在 多样的 包装 样式
- 44-管脚 plcc 和 33 用户 i/o
- 44-管脚 vqfp 和 33 用户 i/o
- 56-球 cp (0.05mm) bga 和 45 用户 i/o
- 100-管脚 vqfp 和 64 用户 i/o
• 优化 为 高 效能 1.8v 系统
- 过激 低 电源 运作
- 先进的 0.18 micron 4-metal layer 非-易变的
处理
• 先进的 系统 特性
- quadruple 增强 安全
- multi-电压 系统 接口
- hot pluggable
- ieee1532 在-系统 可编程序的
- 更好的 管脚 locking 通过 pla 排列
- 输入 hysteresis (施密特 触发) 在 所有 管脚
- 总线 支撑 电路系统 在 所有 用户 管脚
- ieee standard 1149.1 boundary scan (jtag)
- 快 程序编制 时间
- 极好的 管脚 保持 在 设计 改变
- 高 质量 和 可靠性
- 有保证的 10,000 程序/擦掉 循环
- 20 年 数据 保持
谈及 至 这 coolrunner
™
-ii 家族 数据 薄板 为 architec-
ture 描述.
描述
这 coolrunner-ii 64-macrocell 设备 是 设计 为 两个都
高 效能 和 低 电源 产品. 这个 lends
电源 savings 至 高-终止 交流 设备 和
速 至 电池 运作 设备.
这个 设备 组成 的 四 函数 blocks inter-con-
nected 用 一个 低 电源 先进的 interconnect 矩阵变换 (aim).
这 aim feeds 40 输入 至 各自 函数 块. 这 func-
tion blocks 组成 的 一个 40 用 56 p-期 pla 和 16 macro-
cells 这个 包含 numerous 配置 位 那 准许
为 combinational 或者 注册 模式 的 运作. addi-
tionally, 这些 寄存器 能 是 globally 重置 或者 preset 和
配置 作 一个 d 或者 t flip-flop 或者 作 一个 d 获得. 那里 是
也 多样的 时钟 信号, 两个都 global 和 local 产品
期 为基础, 在 一个 每 macrocell 基准. 输出 控制 sig-
nals 包含 回转 比率 控制, 总线 支撑 和 打开 流. 一个
额外的 施密特-触发 输入 是 有 在 一个 每 输入
管脚 基准.
在 增加 至 combinatorial 和 注册 输出, 这 reg-
isters 将 是 配置 作 快 输入.
clocking 是 有 在 一个 global 或者 函数 块 基准.
三 global clocks 是 有 为 所有 函数 blocks 作
一个 同步的 时钟 源. global clocks 是 additionally
使用 至 设置 或者 preset 单独的 macrocell 寄存器 在
电源 向上. local clocks 是 发生 在 明确的 函数
blocks 和 仅有的 有 至 macrocell 寄存器 在 那
函数 块.
一个 dualedge flip-flop 特性 是 也 有 在 一个 每 mac-
rocell 基准. 这个 特性 准许 效能 在哪里 它 是
需要 没有 raising 这 总的 电源 消耗量 的 这
全部 设备.
这 coolrunner-ii 64-macrocell cpld 是 i/o 兼容
和 标准 lvttl33 和 lvcmos18, 25, 和 33 伏特
(看 表格 1).
快 零 电源 设计 技术
所有 coolrunner-ii cplds 雇用 快 零 电源
™
(fzp),
一个 设计 技巧 那 雇用 cmos 技术 在 两个都
这 fabrication 和 设计 methodology. xilinx coolrun-
ner-ii 是 fabricated 在 一个 0.18 micron 处理 技术
这个 是 获得 从 leading 边缘 fpga 产品 开发-
ment. coolrunner-ii 设计 技术 雇用 一个 cascade
的 cmos 门 至 执行 总 的 产品 instead 的 tra-
ditional sense 放大器 methodology. 预定的 至 这个 fzp tech-
nology, xilinx coolrunner-ii cplds 达到 两个都 高
效能 和 低 电源 运作.
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xc2c64 coolrunner-ii cpld
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