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资料编号:1001616
 
资料名称:LPC2105BBD48
 
文件大小: 155K
   
说明
 
介绍:
Single-chip 32-bit microcontrollers; 128 kB ISP/IAP Flash with 64 kB/32 kB/16 kB RAM
 
 


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飞利浦 半导体
lpc2104/2105/2106
单独的-碎片 32-位 微控制器
产品 数据 rev. 04 — 05 二月 2004 17 的 32
9397 750 12792
© koninklijke 飞利浦 electronics n.v. 2004. 所有 权利 保留.
6.12 spi 串行 i/o 控制
这 spi 是 一个 全部 duplex 串行 接口, 设计 至 是 能 至 handle 多样的
masters slaves 连接 一个 总线. 仅有的 一个 单独的 主控 一个 单独的 从动装置
communicate 接口 一个 数据 转移. 一个 数据 转移
这 主控 总是 发送 一个 字节 的 数据 至 这 从动装置, 和 这 从动装置 总是 发送 一个
字节 的 数据 至 这 主控.
6.12.1 特性
一致的 和 串行 附带的 接口 (spi) 规格.
同步的, 串行, 全部 duplex, 交流.
联合的 spi 主控 和 从动装置.
最大 数据 位 比率 的 一个 eighth 的 这 输入 时钟 比率.
6.13 一般 目的 计时器
这 计时器 是 设计 至 计数 循环 的 这 附带的 时钟 (pclk) 和 optionally
发生 中断 或者 执行 其它 actions 在 specified 计时器 值, 为基础 在 四
相一致 寄存器. 它 也 包含 四 俘获 输入 至 trap 这 计时器 值 当 一个
输入 信号 transitions, optionally generating 一个 中断.
6.13.1 特性
一个 32-位 计时器/计数器 和 一个 可编程序的 32-位 预分频器.
向上 至 四 (计时器 1) 和 三 (计时器 0) 32-bit 俘获 channels, 那 能 引领 一个
snapshot 的 这 计时器 值 当 一个 输入 信号 transitions. 一个 俘获 事件 将
也 optionally 发生 一个 中断.
四 32-位 相一致 寄存器 那 准许:
持续的 运作 和 optional 中断 一代 在 相一致.
停止 计时器 在 相一致 和 optional 中断 一代.
重置 计时器 在 相一致 和 optional 中断 一代.
向上 至 四 (计时器 1) 和 三 (计时器 0) 外部 输出 相应的 至 相一致
寄存器, 和 这 下列的 能力:
设置 低 在 相一致.
设置 高 在 相一致.
toggle 在 相一致.
做 nothing 在 相一致.
6.14 看门狗 计时器
这 目的 的 这 看门狗 是 至 重置 这 微控制器 在里面 一个 合理的
数量 的 时间 如果 它 enters 一个 erroneous 状态. 当 使能, 这 看门狗 将
发生 一个 系统 重置 如果 这 用户 程序 失败 至 ‘feed’ (或者 再装填) 这 看门狗
在里面 一个 predetermined 数量 的 时间.
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