max7409/max7410/max7413/max7414
5th-顺序, lowpass,
切换-电容 过滤
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这 区别 在 bessel 和 butterworth 过滤
能 是 observed 当 一个 1khz 正方形的 波 是 应用
至 这 过滤 输入 (图示 1, 查出 一个). 和 这 过滤 截止
发生率 设置 在 5khz, 查出 b 显示 这 bessel 过滤
回馈 和 查出 c 显示 这 butterworth 过滤
回馈.
background 信息
大多数 切换-电容 过滤 (scfs) 是 设计 和
biquadratic sections. 各自 部分 实现 二 过滤-
ing 柱子, 和 这 sections 是 倾泻 至 生产
高等级的-顺序 过滤. 这 有利因素 至 这个 approach 是
使容易 的 设计. 不管怎样, 这个 类型 的 设计 是 高级地
敏感的 至 组件 变化 如果 任何 部分’s q 是
高. 一个 alternative approach 是 至 emulate 一个 被动的 网-
工作 使用 切换-电容 积分器 和 summing
和 范围调整. 图示 2 显示 一个 基本 5th-顺序 ladder 过滤
结构.
一个切换-电容 过滤 此类 作 这 max7409/
max7410/max7413/max7414 emulates一个 被动的 ladder
过滤. 这 过滤’s 组件 敏锐的 是 低 当 com-
pared 至 一个 倾泻 biquad 设计, 因为 各自
组件 affects 这 全部 过滤 shape, 不 just 一个
柱子-零 一双. 在 其它 words, 一个 mismatched 组件
在 一个 biquad 设计 将 有 一个 concentrated 错误 在 它的
各自的 柱子, 当 这 一样 mismatch 在 一个 ladder
过滤 设计 结果 在 一个 错误 distributed 在 所有 柱子.
时钟 信号
外部 时钟
这 max7409/max7410/max7413/max7414 家族 的
scfs 是 设计 为 使用 和 外部 clocks 那 有
一个 50% ±10% 职责 循环. 当 使用 一个 外部 时钟
和 这些 设备, 驱动 clk 和 一个 cmos 门 pow-
ered 从 0 至 v
DD
. varying 这 比率 的 这 外部
时钟 adjusts 这 corner 频率 的 这 过滤 作 fol-
lows:
f
C
= f
CLK
/ 100
内部的 时钟
当 使用 这 内部的 振荡器, 连接 一个 电容
(c
OSC
) 在 clk 和 地面. 这 值 的 这
电容 确定 这 振荡器 频率 作 跟随:
f
OSC
(khz) = 30 x 10
3
/ c
OSC
(pf)
降低 这 偏离 电容 在 clk 所以 那 它 做
不 影响 这 内部的 振荡器 频率. 相异 这 比率
的 这 内部的 振荡器 至 调整 这 过滤’s corner fre-
quency 用 一个 100:1 时钟-至-corner 频率 比率. 为
例子, 一个 内部的 振荡器 频率 的 100khz
生产 一个 名义上的 corner 频率 的 1khz.
输入 阻抗 vs. 时钟 发生率
这 max7409/max7410/max7413/max7414’s 输入
阻抗 是 effectively 那 的 一个 切换-电容
电阻 (看 这 下列的 等式), 和 是 inversely
均衡的 至 频率. 这 输入 阻抗 值
决定 在下 代表 这 平均 输入 imped-
ance, 自从 这 输入 电流 是 不 持续的. 作 一个
rule, 使用 一个 驱动器 和 一个 输出 阻抗 较少 比
10% 的 这 过滤’s 输入 阻抗. 估计 这输入
阻抗 的 这 过滤 使用 这 下列的 formula:
Z
在
= 1 / ( f
CLK
x 2.1pf)
为 例子, 一个 f
CLK
的 100khz 结果 在 一个 输入
阻抗 的 4.8m
Ω
.
L4
C5C3
C1
V
在
+
-
R
L
L2
R
S
图示 2. 5th-顺序 ladder 过滤 网络
一个
2v/div
2v/div
2v/div
C
一个: 1khz 输入 信号
b: max7409 bessel 过滤 回馈; f
C
= 5khz
c: max7410 butterworth 过滤 回馈; f
C
= 5khz
B
200
µ
s/div
图示 1. bessel vs. butterworth 过滤 回馈
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