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典型 效能 特性
(持续)
vs 时钟 频率
f
CLK
f
O
背离
vs 时钟 频率
f
CLK
f
O
背离
背离 的
f
CLK
f
O
vs 名义上的 Q
背离 的
f
CLK
f
O
vs 名义上的 Q
TLH10399–3
管脚 描述
lp(120) bp(219) 这 第二 顺序 lowpass 通带
naphp(318) 和 notchallpasshighpass outputs
这些 输出 能 典型地 下沉 15 毫安
和 源 3 mA 各自 输出 典型地
swings 至 在里面 1V 的 各自 supply
inv(417) 这 反相的 输入 的 这 summing 运算-
放大 的 各自 filter 这些 是 高 im-
pedance inputs 但是 这 非-反相的 在-
放 是 内部 系 至 AGND 制造
INV
一个
和 INV
B
behave 像 summing
汇合处 (低 impedance 电流 在-
puts)
s1(516) S1 是 一个 信号 输入 管脚 使用 在 这 所有-
通过 过滤 配置 (看 模式 4
和 5) 这 管脚 应当 是 驱动 和 一个
源 阻抗 的 较少 比 1 k
X
If
S1 是 不 驱动 和 一个 信号 它 应当 是
系 至 AGND (mid-供应)
S
AB
(6) 这个 管脚 activates 一个 转变 那 connects
一个 的 这 输入 的 各自 filter’s 第二
summer 至 也 AGND (s
AB
系 至
V
b
) 或者 至 这 lowpass (lp) 输出 (s
AB
系 至 V
一个
) 这个 提供 这 flexibility
需要 为 configuring 这 过滤 在 它的
各种各样的 模式 的 operation
V
一个
一个
(7)v
D
一个
(8) 相似物 积极的 供应 和 数字的 posi-
tive supply 这些 管脚 是 内部
连接 通过 这 IC 基质 和
因此 V
一个
一个
和 V
D
一个
应当 是 de-
rived 从 这 一样 电源 供应
source 它们 有 被 brought 输出
separately 所以 它们 能 是 绕过 用
独立的 capacitors 如果 desired 它们
能 是 externally 系 一起 和 用-
passed 用 一个 单独的 capacitor
V
一个
b
(14) V
D
b
(13) 相似物 和 数字的 负的 supplies
这 一样 comments 作 为 V
一个
一个
和
V
D
一个
应用 here
5

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典型效能特性 (持续) vs 时钟频率 f CLK f O 背离 vs 时钟频率 f CLK f O 背离背离的 f CLK f O vs 名义上的 Q 背离的 f CLK f O vs 名义上的 Q TLH10399–3 管脚描述 lp(120) bp(219) 这第二顺序 lowpass 通带 naphp(318) 和 notchallpasshighpass outputs 这些输出能典型地下沉 15 毫安和源 3 mA 各自输出典型地 swings 至在里面 1V 的各自 supply inv(417) 这反相的输入的这 summing 运算- 放大的各自 filter 这些是高 im- pedance inputs 但是这非-反相的在- 放是内部系至 AGND 制造 INV 一个和 INV B behave 像 summing 汇合处 (低 impedance 电流在- puts) s1(516) S1 是一个信号输入管脚使用在这所有- 通过过滤配置 (看模式 4 和 5) 这管脚应当是驱动和一个源阻抗的较少比 1 k X If S1 是不驱动和一个信号它应当是系至 AGND (mid-供应) S AB (6) 这个管脚 activates 一个转变那 connects 一个的这输入的各自 filter’s 第二 summer 至也 AGND (s AB 系至 V b ) 或者至这 lowpass (lp) 输出 (s AB 系至 V 一个 ) 这个提供这 flexibility 需要为 configuring 这过滤在它的各种各样的模式的 operation V 一个一个 (7)v D 一个 (8) 相似物积极的供应和数字的 posi- tive supply 这些管脚是内部连接通过这 IC 基质和因此 V 一个一个和 V D 一个应当是 de- rived 从这一样电源供应 source 它们有被 brought 输出 separately 所以它们能是绕过用独立的 capacitors 如果 desired 它们能是 externally 系一起和用- passed 用一个单独的 capacitor V 一个 b (14) V D b (13) 相似物和数字的负的 supplies 这一样 comments 作为 V 一个一个和 V D 一个应用 here 5

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