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8XC151SASB 高-效能 CHMOS 微控制器
直流 特性
参数 值 应用 至 所有 设备 除非 否则 indicated
表格 8 直流 特性 在 V
CC
e
45V
b
55V
标识 参数 最小值 典型 最大值 单位 测试 情况
V
IL
输入 低 电压
b
05 02V
CC
b
01 V
(除了 EA

)
V
IL1
输入 低 电压 0 02V
CC
b
03 V
(ea

)
V
IH
输入 高 电压 02V
CC
一个
09 V
CC
一个
05 V
(除了 XTAL1 rst)
V
IH1
输入 高 电压 07V
CC
V
CC
一个
05 V
(xtal1 rst)
V
OL
输出 低 电压 03 V I
OL
e
100
m
一个
(端口 1 2 3) 045 I
OL
e
16 毫安
10 I
OL
e
35 毫安
(便条 1 便条 2)
V
OL1
输出 低 电压 03 V I
OL
e
200
m
一个
(端口 0 ALE PSEN

) 045 I
OL
e
32 毫安
10 I
OL
e
70 毫安
(便条 1 便条 2)
V
OH
输出 高 电压 V
CC
b
03 V I
OH
eb
10
m
一个
(端口 1 2 3 ALE V
CC
b
07 I
OH
eb
30
m
一个
PSEN

)v
CC
b
15 I
OH
eb
60
m
一个
(便条 3)
NOTES
1 下面 稳步的-状态 (非-瞬时) conditions I
OL
必须 是 externally 限制 作 follows
最大 I
OL
每 端口 pin 10 毫安
最大 I
OL
每 8-位 port
端口 0 26 毫安
端口 1–3 15 毫安
最大 总的 I
OL
为
所有 输出 管脚 71 毫安
如果 I
OL
超过 这 测试 conditions V
OL
将 超过 这 related specification 管脚 是 不 有保证的 至 下沉 电流
更好 比 这 列表 测试 conditions
2 电容的 加载 在 端口 0 和 2 将 导致 spurious 噪音 脉冲 在之上 04V 在 这 低-水平的 输出 的 ALE 和
端口 1 2 和 3 这 噪音 是 预定的 至 外部 总线 电容 discharging 在 这 端口 0 和 端口 2 管脚 当 这些
管脚 改变 从 高 至 low 在 产品 在哪里 电容的 加载 超过 100 pF 这 噪音 脉冲 在 这些
信号 将 超过 08V 它 将 是 desirable 至 qualify ALE 或者 其它 信号 和 一个 施密特 触发 或者 cmos-水平的 输入
logic
3 电容的 加载 在 端口 0 和 2 导致 这 V
OH
在 ALE 和 PSEN

至 漏出 在下 这 规格 当 这
地址 线条 是 stabilizing
4 典型 值 是 得到 使用 V
CC
e
50 T
一个
e
25

C 和 是 不 guaranteed
13

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8XC151SASB 高-效能 CHMOS 微控制器直流特性参数值应用至所有设备除非否则 indicated 表格 8 直流特性在 V CC e 45V b 55V 标识参数最小值典型最大值单位测试情况 V IL 输入低电压 b 05 02V CC b 01 V (除了 EA  ) V IL1 输入低电压 0 02V CC b 03 V (ea  ) V IH 输入高电压 02V CC 一个 09 V CC 一个 05 V (除了 XTAL1 rst) V IH1 输入高电压 07V CC V CC 一个 05 V (xtal1 rst) V OL 输出低电压 03 V I OL e 100 m 一个 (端口 1 2 3) 045 I OL e 16 毫安 10 I OL e 35 毫安 (便条 1 便条 2) V OL1 输出低电压 03 V I OL e 200 m 一个 (端口 0 ALE PSEN  ) 045 I OL e 32 毫安 10 I OL e 70 毫安 (便条 1 便条 2) V OH 输出高电压 V CC b 03 V I OH eb 10 m 一个 (端口 1 2 3 ALE V CC b 07 I OH eb 30 m 一个 PSEN  )v CC b 15 I OH eb 60 m 一个 (便条 3) NOTES 1 下面稳步的-状态 (非-瞬时) conditions I OL 必须是 externally 限制作 follows 最大 I OL 每端口 pin 10 毫安最大 I OL 每 8-位 port 端口 0 26 毫安端口 1–3 15 毫安最大总的 I OL 为所有输出管脚 71 毫安如果 I OL 超过这测试 conditions V OL 将超过这 related specification 管脚是不有保证的至下沉电流更好比这列表测试 conditions 2 电容的加载在端口 0 和 2 将导致 spurious 噪音脉冲在之上 04V 在这低-水平的输出的 ALE 和端口 1 2 和 3 这噪音是预定的至外部总线电容 discharging 在这端口 0 和端口 2 管脚当这些管脚改变从高至 low 在产品在哪里电容的加载超过 100 pF 这噪音脉冲在这些信号将超过 08V 它将是 desirable 至 qualify ALE 或者其它信号和一个施密特触发或者 cmos-水平的输入 logic 3 电容的加载在端口 0 和 2 导致这 V OH 在 ALE 和 PSEN  至漏出在下这规格当这地址线条是 stabilizing 4 典型值是得到使用 V CC e 50 T 一个 e 25  C 和是不 guaranteed 13

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