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管脚 函数 描述
(持续)
为 instance 不能 是 使保持 为 更多 比 4 seconds
这些 水平 是 为基础 在 40

C 最大 最初的 碎片 tem-
perature 当 驱动 inductive loads 总是 使用 一个 clamp
二极管 至 保护 这 晶体管 从 inductive kick-back
一个
boost
管脚 是 提供 在 这 LM122 至 增加 这 速
的 这 内部的 comparator 这 比较器 是 正常情况下 运算-
erated 在 低 电流 水平 为 最低 可能 输入 current
为 定时 时期 较少 比 1 ms 在哪里 低 输入 电流 是
不 needed 比较器 运行 电流 能 是 增加
一些 顺序 的 magnitude Shorting 这 boost 终端 至
V
一个
增加 这 发射级 电流 的 这 vertical PNP 驱动器
在 这 差别的 平台 从 25 nA 至 5
m
A 这个 管脚 是 不
有 在 这 LM3905
和 这 计时器 在 这 unboosted state 定时 时期 是
精确 向下 至 关于 1 ms 在 这 boosted mode 丧失 的
精度 预定的 至 比较器 速 是 仅有的 关于 800 ns 所以
定时 时期 的 一些 microseconds 能 是 used 这
800 ns 错误 是 相当地 insensitive 至 temperature 所以 tem-
perature 系数 的 脉冲波 宽度 是 安静的 good
这
逻辑
管脚 是 使用 至 反转 这 信号 appearing 在 这
输出 transistor 一个 打开 或者 ‘‘high’’ 情况 在 这
逻辑
管脚 programs 这 输出 晶体管 至 是 ‘‘off’’ 在 这
定时 时期 和 ‘‘on’’ 所有 其它 times Grounding 这
逻辑
管脚 reverses 这 sequence 至 制造 这 晶体管 ‘‘on’’ dur-
ing 这 定时 period 门槛 为 这
逻辑
管脚 是 典型地
100 mV 和 150
m
一个 流 输出 的 这 terminal 如果 一个 起作用的
驱动 至 这
逻辑
管脚 是 desired 一个 saturated 晶体管 驱动
是 recommended 也 和 一个 分离的 晶体管 或者 这
打开 集电级 输出 的 整体的 logic 一个 最大 V
SAT
的 25 mV 在 200
m
一个 是 required 最小 和 最大
电压 那 将 呈现 在 这
逻辑
管脚 是 0 和
一个
50
respectively
典型 产品
基本 计时器
图示 1
是 一个 基本 计时器 使用 这 集电级 output R
t
和 C
t
设置 这 时间 间隔 和 R
L
作 这 load 在 这 定时
间隔 这 输出 将 是 也 高 或者 低 取决于 在
这 连接 的 这 逻辑 pin 定时 波形 是
显示 在 这 sketch along 一侧
图示 1
 便条 那 这 trig-
ger 脉冲波 将 是 也 shorter 或者 变长 比 这 输出
脉冲波 width
图示 2
是 又一次 一个 基本 timer 但是 和 这 输出 带去
从 这 发射级 的 这 输出 transistor 作 和 这 collec-
tor output 也 一个 高 或者 低 情况 将 是 得到
在 这 定时 period
Simulating 一个 热的 延迟 接转
图示 3
是 一个 应用 在哪里 这 LM122 是 使用 至 simu-
late 一个 热的 延迟 接转 这个 阻止 电源 从 正在
应用 至 其它 电路系统 直到 这 供应 有 被 在 为
一些 time 这 接转 仍然是 de-energized 为 R
t
C
t
秒-
onds 之后 V
CC
是 applied 然后 closes 和 stays energized
直到 V
CC
是 转变 off
图示 4
是 一个 类似的 电路 除了 那
这 接转 是 energized 作 soon 作 V
CC
是 applied R
t
C
t
秒-
onds later 这 接转 是 de-energized 和 stays 止 直到 这
V
CC
供应 是 recycled
TLH7768–11
图示 1 基本 计时器-集电级
输出 和 定时 Chart
TLH7768–12
图示 2 基本 计时器-发射级 输出 和 定时 Chart
TLH7768–13
图示 3 时间 输出 在 电源 向上
(接转 Energized R
t
C
t
秒 之后 V
CC
是 应用)
一个
5V 供应 驱动 28V 接转
图示 5
显示 这 计时器 接合 5V 逻辑 至 一个 高 volt-
age relay 虽然 这 V
一个
终端 可以 是 系 至 这
一个
28V supply 这个 将 是 一个 unnecessary waste 的 电源
在 这 IC 或者 需要 extra 线路 如果 这 LM122 是 在 一个 逻辑
card 在 也 case 这 门槛 为 这 触发 是 16V
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管脚函数描述 (持续) 为 instance 不能是使保持为更多比 4 seconds 这些水平是为基础在 40  C 最大最初的碎片 tem- perature 当驱动 inductive loads 总是使用一个 clamp 二极管至保护这晶体管从 inductive kick-back 一个 boost 管脚是提供在这 LM122 至增加这速的这内部的 comparator 这比较器是正常情况下运算- erated 在低电流水平为最低可能输入 current 为定时时期较少比 1 ms 在哪里低输入电流是不 needed 比较器运行电流能是增加一些顺序的 magnitude Shorting 这 boost 终端至 V 一个增加这发射级电流的这 vertical PNP 驱动器在这差别的平台从 25 nA 至 5 m A 这个管脚是不有在这 LM3905 和这计时器在这 unboosted state 定时时期是精确向下至关于 1 ms 在这 boosted mode 丧失的精度预定的至比较器速是仅有的关于 800 ns 所以定时时期的一些 microseconds 能是 used 这 800 ns 错误是相当地 insensitive 至 temperature 所以 tem- perature 系数的脉冲波宽度是安静的 good 这逻辑管脚是使用至反转这信号 appearing 在这输出 transistor 一个打开或者 ‘‘high’’ 情况在这逻辑管脚 programs 这输出晶体管至是 ‘‘off’’ 在这定时时期和 ‘‘on’’ 所有其它 times Grounding 这逻辑管脚 reverses 这 sequence 至制造这晶体管 ‘‘on’’ dur- ing 这定时 period 门槛为这逻辑管脚是典型地 100 mV 和 150 m 一个流输出的这 terminal 如果一个起作用的驱动至这逻辑管脚是 desired 一个 saturated 晶体管驱动是 recommended 也和一个分离的晶体管或者这打开集电级输出的整体的 logic 一个最大 V SAT 的 25 mV 在 200 m 一个是 required 最小和最大电压那将呈现在这逻辑管脚是 0 和一个 50 respectively 典型产品基本计时器图示 1 是一个基本计时器使用这集电级 output R t 和 C t 设置这时间间隔和 R L 作这 load 在这定时间隔这输出将是也高或者低取决于在这连接的这逻辑 pin 定时波形是显示在这 sketch along 一侧图示 1  便条那这 trig- ger 脉冲波将是也 shorter 或者变长比这输出脉冲波 width 图示 2 是又一次一个基本 timer 但是和这输出带去从这发射级的这输出 transistor 作和这 collec- tor output 也一个高或者低情况将是得到在这定时 period Simulating 一个热的延迟接转图示 3 是一个应用在哪里这 LM122 是使用至 simu- late 一个热的延迟接转这个阻止电源从正在应用至其它电路系统直到这供应有被在为一些 time 这接转仍然是 de-energized 为 R t C t 秒- onds 之后 V CC 是 applied 然后 closes 和 stays energized 直到 V CC 是转变 off 图示 4 是一个类似的电路除了那这接转是 energized 作 soon 作 V CC 是 applied R t C t 秒- onds later 这接转是 de-energized 和 stays 止直到这 V CC 供应是 recycled TLH7768–11 图示 1 基本计时器-集电级输出和定时 Chart TLH7768–12 图示 2 基本计时器-发射级输出和定时 Chart TLH7768–13 图示 3 时间输出在电源向上 (接转 Energized R t C t 秒之后 V CC 是应用) 一个 5V 供应驱动 28V 接转图示 5 显示这计时器接合 5V 逻辑至一个高 volt- age relay 虽然这 V 一个终端可以是系至这一个 28V supply 这个将是一个 unnecessary waste 的电源在这 IC 或者需要 extra 线路如果这 LM122 是在一个逻辑 card 在也 case 这门槛为这触发是 16V 7

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