MC33560
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card vcc 和 card 时钟 程序编制
这 crdv
CC
和 asyclk 程序编制 选项 准许 这 系统 时钟 频率 至 是 matched 至 这 card 时钟
频率 和 至 选择 3v 或者 5v crdv
CC
供应. 表格 3 显示 这 值 的
PWRON
,
重置
和
IO
为 这 可能
选项. 这 default 电源 重置 情况 是 状态 4 (同步的 时钟 和 crdv
CC
=5v). 所有 states 是 latched 为 各自
输出 能变的 在 程序编制 模式 在 这 积极的 转变 的
CS
(看 图示 20).
表格 3 : card vcc 和 card 时钟 真实 表格
STATE# PWRON 重置 IO CRDV
CC
CRDCLK
0 L L L 3V SYNCLK
1 L L H 3V asyclkin/4
2 L H H 3V asyclkin/2
3 L H L 3V ASYCLKIN
4 H L L 5V SYNCLK
5 H L H 5V asyclkin/4
6 H H H 5V asyclkin/2
7 H H L 5V ASYCLKIN
便条 : card 时钟 integrity 是 maintained 在 所有 频率 commutations (非 尖刺).
状态 4 是 这 default 状态 在 电源 在.
直流/直流 转换器 和 card 探测器 状态
这 mc33560 状态 能 是 polled 当
CS=
L
. 请 咨询 表格 2 为 一个 描述 的 输入 和 输出 信号.这
significance 的 这 状态 message 是 描述 在 表格 4.
表格 4 : rdymod 状态 messages
PWRON
(输入)
RDYMOD
(输出)
Message
低 低 非 card
低 高 card 呈现
高 低 直流/直流 转换器 超载
高 高 直流/直流 转换器 ok
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