74LVXZ161284_集成电路资料查询网

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74LVXZ161284
逻辑 标识
连接 图解 管脚 描述
真实 表格
便条 1:
Y
9
–
Y
13
打开 流 输出 和 1.4 k
Ω
pullups
便条 2:
B
1
–
B
8
打开 流 输出 和 1.4 k
Ω
pullups
管脚 names 描述
HD 高 驱动 使能 输入 (起作用的 高)
DIR 方向 控制 输入
一个
1
–
一个
8
输入 或者 输出
B
1
–
B
8
输入 或者 输出
一个
9
–
一个
13
输入
Y
9
–
Y
13
输出
一个
14
–
一个
17
输出
C
14
–
C
17
输入
PLH
在
附带的 逻辑 高 输入
PLH 附带的 逻辑 高 输出
HLH
在
host 逻辑 高 输入
HLH host 逻辑 高 输出
输入 输出
DIR HD
LLB
1
–
B
8
数据 至 一个
1
–
一个
8
, 和
一个
9
–
一个
13
数据 至 y
9
–
Y
13
(便条 1)
C
14
–
C
17
数据 至 一个
14
–
一个
17
plh 打开 流 模式
LHB
1
–
B
8
数据 至 一个
1
–
一个
8
, 和
一个
9
–
一个
13
数据 至 y
9
–
Y
13
C
14
–
C
17
数据 至 一个
14
–
一个
17
HLA
1
–
一个
8
数据 至 b
1
–
B
8
(便条 2)
一个
9
–
一个
13
数据 至 y
9
–
Y
13
(便条 1)
C
14
–
C
17
数据 至 一个
14
–
一个
17
plh 打开 流 模式
HHA
1
–
一个
8
数据 至 b
1
–
B
8
一个
9
–
一个
13
数据 至 y
9
–
Y
13
C
14
–
C
17
数据 至 一个
14
–
一个
17

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www.fairchildsemi.com 2 74LVXZ161284 逻辑标识连接图解管脚描述真实表格便条 1: Y 9 – Y 13 打开流输出和 1.4 k Ω pullups 便条 2: B 1 – B 8 打开流输出和 1.4 k Ω pullups 管脚 names 描述 HD 高驱动使能输入 (起作用的高) DIR 方向控制输入一个 1 – 一个 8 输入或者输出 B 1 – B 8 输入或者输出一个 9 – 一个 13 输入 Y 9 – Y 13 输出一个 14 – 一个 17 输出 C 14 – C 17 输入 PLH 在附带的逻辑高输入 PLH 附带的逻辑高输出 HLH 在 host 逻辑高输入 HLH host 逻辑高输出输入输出 DIR HD LLB 1 – B 8 数据至一个 1 – 一个 8 , 和一个 9 – 一个 13 数据至 y 9 – Y 13 (便条 1) C 14 – C 17 数据至一个 14 – 一个 17 plh 打开流模式 LHB 1 – B 8 数据至一个 1 – 一个 8 , 和一个 9 – 一个 13 数据至 y 9 – Y 13 C 14 – C 17 数据至一个 14 – 一个 17 HLA 1 – 一个 8 数据至 b 1 – B 8 (便条 2) 一个 9 – 一个 13 数据至 y 9 – Y 13 (便条 1) C 14 – C 17 数据至一个 14 – 一个 17 plh 打开流模式 HHA 1 – 一个 8 数据至 b 1 – B 8 一个 9 – 一个 13 数据至 y 9 – Y 13 C 14 – C 17 数据至一个 14 – 一个 17

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