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资料编号:1098507
 
资料名称:PE3236
 
文件大小: 251.12K
   
说明
 
介绍:
Integer-N Phase Locked-Loop (PLL) Frequency Synthesizers
 
 


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产品 规格
PE3236
页 7 的 15
文档 非. 70-0026-03
www.psemi.com
©2003-2005 peregrine 半导体 corp. 所有 权利 保留.
函数的 描述
这 pe3236 组成 的 一个 预分频器, counters, 一个
阶段 探测器 和 控制 逻辑. 这 双
modulus 预分频器 divides 这 vco 频率 用
也 10 或者 11, 取决于 在 这 值 的 这
modulus 选择. counters “r” 和“m” 分隔 这
涉及 和 预分频器 输出, 各自, 用
integer 值 贮存 在 一个 20-位 寄存器. 一个
额外的 计数器 (“a”) 是 使用 在 这 modulus
选择 逻辑. 这 阶段-频率 探测器
发生 向上 和 向下 频率 控制 信号.
这 控制 逻辑 包含 一个 可选择的 碎片
接口. 数据 能 是 写 通过 串行 总线,
并行的 总线, 或者 hardwired 直接 至 这 管脚. 那里
是 也 各种各样的 运算的 和 测试 模式 和
锁 发现.
图示 4. 函数的 块 图解
控制
逻辑
r 计数器
(6-位)
Phase
探测器
f
c
pd_u
pd_d
LD
r(5:0)
m(8:0)
一个(3:0)
d(7:0)
Sdata
控制
管脚
f
r
Modulus
选择
10/11
预分频器
m 计数器
(9-位)
Cext
f
p
F
F
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