相似物 整体的电路 设备 数据
4 freescale 半导体
33742
终端 连接
终端 连接
图示 3. 33742
终端 连接
WDOG
MISO
SCLK
地
地
地
地
CANL
CANH
L3
L2
L1
CS
MOSI
RXD
RST
INT
地
地
地
地
V2
V2CTRL
VSUP
HS
L0
TXD
VDD
4
5
6
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26
1
表格 2. 33742 终端 定义
一个 函数的 描述 的 各自 终端 能 是 建立 在 这函数的 终端 描述部分 beginning 在 页 20.
终端
终端
名字
formal 名字 定义
1RXD receive 数据
能 总线 receive 数据 输出 终端.
2 TXD transmit 数据
能 总线 transmit 数据 输入 终端.
3
VDD 电压 数字的 流
5.0 v 调整器 输出 终端. 供应 终端 为 这 mcu.
4 RST 重置 输出
(起作用的 低)
这个 是 这 设备 重置 输出 终端 whose 主要的 函数 是 至 重置 这 mcu. 这个
终端 有 一个 内部的 pullup 电流 源 至 vdd.
5 INT 中断 输出
(起作用的 低)
这个 输出 是 asserted 低 当 一个 使能中断 情况 occurs. 这 输出 是
一个 推-拉 结构.
6–9
20–23
地 地面
这些 设备 地面 terminals 是 内部连接 至 这 包装 含铅的 框架 至
提供 一个 33742-至-pcb 热的 path.
10 V2 电压 源 2
sense 输入 为 这 v2 调整器 使用 一个 external 序列 通过 晶体管. v2 是 也 这
内部的 供应 为 这 能 transceiver.
11 V2CTRL 电压 源 2 控制
输出 驱动 源 为 这 v2 调整器 connected 至 这 外部 序列 通过 晶体管.
12 VSUP 电压 供应
供应 输入 终端 为 这 33742.
13 HS 高-一侧 输出
输出 的 这 内部的 高-一侧 转变. 这 output 电流 是 内部 限制 至 150 毫安.
14–17 l0-L3 水平的 0-3 输入
输入 从 外部 switches或者 从 逻辑 电路系统.
18 CANH 能 高 输出
能 高 输出 终端.
19 CANL 能 低 输出
能 低 输出 终端.
24 SCLK 串行 数据 时钟
时钟 输入 终端 为 这 串行 附带的 接口 (spi).
25 MISO 主控 在从动装置 输出
spi 数据 sent 至 这 mcu 用 这 33742. 当 cs 是 高, 这 终端 是 在 这 高-
阻抗 状态.
26 MOSI 主控 输出从动装置 在
spi 数据 received 用 这 33742.
27
CS
碎片 选择
(起作用的 低)
这 cs 输入 终端 是 使用 和 这 spi 总线 至 选择 这 33742. 当 这 cs 是
asserted 低, 这 33742 是 这 选择 设备 的 这 spi 总线.
28
WDOG
看门狗 输出
(起作用的 低)
这 wdog 输出 终端 是 asserted 低如果 这 软件 看门狗 是 不 correctly
triggered.
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