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资料编号:1132494
 
资料名称:MSM7731-01
 
文件大小: 247.99K
   
说明
 
介绍:
Multifunction PCM CODEC (Voice Signal Processor)
 
 


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¡ 半导体
msm7731-01
同步
这个 是 这 8 khz 同步 信号 i/o 管脚 为 数字的 数据 交流. 这个 管脚 是 切换 至
函数 作 一个 输入 或者 输出 用 这 clksel 管脚. 如果 这 内部的 时钟 模式 是 选择 用 这
clksel 管脚, 一个 8 khz 时钟 同步 至 这 bclk 信号 是 输出 和 数字的 数据
交流 是 执行. 如果 这 外部 时钟 模式 是 选择 用 这 clksel 管脚, 这个 管脚
变为 一个 输入 那 需要 一个 8 khz 时钟 输入 同步 至 这 bclk 管脚, 和 数字的
数据 交流 是 执行 为基础 在 这个 输入 时钟. fixing 这个 信号 至 一个 逻辑 "1" 或者
逻辑 "0" 导致 这个 设备 至 内部 写 一个 逻辑 "1" 至 这 pdn/rst (cr0-b7) 位 的 这
控制 寄存器, 和 至 enter 这 电源-向下 重置 状态. 这个 自动 电源-向下 控制
是 有效的 当 外部 时钟 模式 是 选择 用 这 clksel 管脚 和 自动 电源-向下
控制 有 被 转变 在 用 这 sypdn (cr11-b0) 位 的 这 控制 寄存器.
BCLK
这个 是 这 变换 时钟 i/o 管脚 为 数字的 数据 交流. 这个 管脚 是 切换 至 函数
作 一个 输入 或者 输出 用 这 clksel 管脚. 如果 这 内部的 时钟 模式 是 选择 用 这 clksel
管脚, 一个 64 khz 或者 128 khz 时钟 同步 至 这 同步 信号 是 输出 和 数字的 数据
交流 是 执行. 切换 在 64 khz 和 128 khz 是 执行 用 这
pcmsel 管脚. 如果
m
-law pcm 是 选择 用 这 pcmsel 管脚, 一个 64 khz 时钟 是 输出. 或者, 如果 16-
位 直线的 模式 是 选择, 一个 128 khz 时钟 是 输出. 如果 这 外部 时钟 模式 是 选择 用
这 clksel 管脚, 这个 管脚 变为 一个 输入 那 需要 一个 时钟 输入 同步 至 这
同步. 在 这个 情况, 这 时钟 频率 范围 是 从 64 khz 至 2048 khz.
CLKSEL
这个 管脚 选择 内部的 或者 外部 时钟 模式 为 这 同步 和 bclk 信号. 一个 逻辑 "0"
选择 这 内部的 时钟 模式. 在 这个 时间, 同步 和 bclk 管脚 是 配置 作 输出 管脚
和 各自 内部 发生 时钟 是 输出 至 执行 数字的 数据 交流. 一个 逻辑
"1" 选择 这 外部 时钟 模式 和 configures 这 同步 和 bclk 管脚 作 输入 管脚. 在
这个 时间, 数字的 数据 交流 是 执行 和 这 externally 输入 同步 和 bclk
clocks. 如果 数字的 数据 交流 是 不 使用, 设置 这个 管脚 至 一个 逻辑 "0" 至 选择 内部的
clocks. 如果 这 管脚 设置 是 changed, 重置 必须 是 使活动 用 也 这
PDN
/
RST
管脚 或者 这
pdn/rst 位 (cr0-b7).
PCMI
这个 是 这 数字的 receive 信号 输入 管脚 在 这 线条-一侧. 这个 输入 信号 是 shifted 在 这
rising 边缘 的 这 bclk 信号 和 输入. 这 beginning 的 数字的 数据 是 identified 在 这 rising
边缘 的 这 同步 信号. 这 编码 format 能 是 选择 作
m
-law pcm 或者 16-位 直线的 (2's
complement) 用 这 pcmsel 管脚. 如果 这 pcmi 管脚 是 不 使用, 设置 它 至 一个 逻辑 "1" 如果
m
-law pcm
有 被 选择, 或者 一个 逻辑 "0" 如果 16-位 直线的 模式 有 被 选择. 这 同步 format 能 是
选择 作 正常的-同步 或者 短的-框架-同步 用 这 syncsel 管脚. 谈及 至 图示 3 为 这
定时. 这个 数字的 输入 信号 是 增加 内部 至 这 codec 数字的 输出 信号. 是
细致的 的 overflow 当 使用 这 codec.
PCMO
这个 是 这 数字的 transmit 信号 输出 管脚 在 这 线条-一侧. 这个 输出 信号 是 同步
至 这 rising 边缘 的 这 bclk 和 同步 信号 和 然后 输出. 当 不 使用 为 输出,
这个 管脚 是 在 这 高 阻抗 状态. 它 是 也 在 高 阻抗 在 这 电源-向下 重置
和 这 最初的 模式. 这 编码 format 能 是 选择 作
m
-law pcm 或者 16-位 直线的 (2's
complement) 用 这 pcmsel 管脚. 这 同步 format 能 是 选择 作 正常的-同步 或者 短的-
框架-同步 用 这 syncsel 管脚. 谈及 至 图示 3 为 这 定时.
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