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资料编号:116102
 
资料名称:A54SX08-TQ208PP
 
文件大小: 415.89K
   
说明
 
介绍:
54SX Family FPGAs
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
54sx 家族 fpgas
6 v3.1
routing resources
clusters 和 superclusters can 是 连接 通过 这
使用 的 二 革新的 local routing resources called
FastConnect
directconnect,
这个 使能 极其
快 和 predictable interconnection 的 modules 在里面
clusters 和 superclusters (图示 5图示 6 在
7). 这个 routing architecture 也 dramatically 减少
这 号码 的 antifuses required 至 完全 一个 电路,
ensuring 这 最高的 可能 效能.
directconnect 是 一个 horizontal routing resource 那 提供
连接 从 一个 c-cell 至 它s neighboring r-cell 在 一个 给
supercluster. directconnect 使用一个 hard-连线的 信号 path
需要 非 可编程序的 interconnection 至 达到 它的
快 信号 传播 时间 的 较少 比 0.1 ns.
fastconnect 使能 horizontal routing 在 任何 二
逻辑 modules 在里面 一个 给n supercluster 和 vertical
routing 和 这 supercluster 立即 在下 它. 仅有的
一个 可编程序的 连接 是 使用 在 一个 fastconnect
path, 传送 最大 管脚-至-管脚 传播 的 0.4 ns.
在 增加 至 directconnect 和 fastconnect, 这
architecture 制造 使用 的 二 globally 朝向 routing
resources 知道 作 segmented routing 和 高-驱动
routing. actel’s segmented routing 结构 提供 一个
多样性 的 追踪 长度 为 极其 快 routing 在
superclusters. 这 精确的 combination 的 追踪 长度 和
antifuses 在里面 各自 path是 选择 用 这 100 百分比
自动 放置 和 route 所以ftware 至 降低 信号
传播 延迟.
actel’s 高-驱动 routing structure 提供 三 时钟
网络. 这 第一 时钟, called hclk, 是 hard 连线的 从
这 hclk 缓存区 至 这 时钟 select mux 在 各自 r-cell. 这个
提供 一个 快 传播path 为 这 时钟 信号,
enabling 这 3.7 ns 时钟-至-输出 (管脚-至-管脚) 效能 的
这 sx 设备. 这 hard-连线的时钟 是 tuned 至 提供
时钟 skew 作 低 作 0.25 ns. 这 remaining 二 clocks
(clka, clkb) 是 global clocks 那 能 是 sourced 从
外部 管脚 或者 从 internal 逻辑 信号 在里面 这 sx
设备.
图示 4
cluster organization
类型 1 supercluster 类型 2 supercluster
cluster 1 cluster 2 cluster 2 cluster 1
r-cell c-cell
D0
D1
D2
D3
DB
A0 B0 A1 B1
Sa Sb
Y
直接
连接
输入
clka,
clkb,
内部的 逻辑
HCLK
CKS CKP
CLRB
PSETB
YDQ
Routed
数据 输入
S0
S1
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