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8018680188
表格 1 管脚 描述
(持续)
标识
管脚
类型 名字 和 函数
No
支撑 50 I 支撑 indicates 那 另一 总线 主控 是 requesting 这 local bus 这
支撑 输入 是 起作用的 HIGH 支撑 将 是 异步的 和 遵守 至 这
HLDA 51 O
处理器 clock 这 处理器 将 公布 一个 HLDA (高) 在 回馈 至 一个
支撑 要求 在 这 终止 的 T
4
或者 T
i
 同时发生的 和 这 issuance 的
HLDA 这 处理器 将 float 这 local 总线 和 控制 lines 之后 支撑 是
发现 作 正在 LOW 这 处理器 将 更小的 HLDA 当 这 处理器
needs 至 run 另一 总线 cycle 它 将 又一次 驱动 这 local 总线 和 控制
lines
UCS 34 O Upper 记忆 碎片 选择 是 一个 起作用的 低 输出 whenever 一个 记忆
涉及 是 制造 至 这 定义 upper portion (1k–256K 块) 的 memory
这个 线条 是 不 floated 在 总线 HOLD 这 地址 范围 activating UCS
是
软件 programmable
LCS 33 O 更小的 记忆 碎片 选择 是 起作用的 低 whenever 一个 记忆 涉及 是
制造 至 这 定义 更小的 portion (1k–256k) 的 memory 这个 线条 是 不
floated 在 总线 HOLD 这 地址 范围 activating LCS
是 软件
programmable
MCS0 38 O mid-范围 记忆 碎片 选择 信号 是 起作用的 低 当 一个 记忆
涉及 是 制造 至 这 定义 mid-范围 portion 的 记忆 (8k–512k)
MCS1
37 O
这些 线条 是 不 floated 在 总线 HOLD 这 地址 范围 activating
MCS2
36 O
MCS0–3 是 软件 programmable
MCS3
35 O
PCS0 25 O 附带的 碎片 选择 信号 0–4 是 起作用的 低 当 一个 涉及 是 制造
至 这 定义 附带的 范围 (64 Kbyte IO 空间) 这些 线条 是 不
PCS1
27 O
floated 在 总线 HOLD 这 地址 范围 activating PCS0–4 是
PCS2
28 O
软件 programmable
PCS3
29 O
PCS4
30 O
PCS5A1 31 O 附带的 碎片 选择 5 或者 Latched A1 将 是 编写程序 至 提供 一个
sixth 附带的 碎片 select 或者 至 提供 一个 内部 latched A1 signal 这
地址 范围 activating PCS5
是 软件-programmable PCS5A1 做
不 float 在 总线 HOLD 当 编写程序 至 提供 latched A1 这个 管脚
将 retain 这 先前 latched 值 在 HOLD
PCS6A2 32 O 附带的 碎片 选择 6 或者 Latched A2 将 是 编写程序 至 提供 一个
seventh 附带的 碎片 select 或者 至 提供 一个 内部 latched A2 signal
这 地址 范围 activating PCS6 是 软件 programmable PCS6A2
做 不 float 在 总线 HOLD 当 编写程序 至 提供 latched A2
这个 管脚 将 retain 这 先前 latched 值 在 HOLD
DTR 40 O 数据 TransmitReceive 控制 这 方向 的 数据 流动 通过 一个
外部 数据 总线 transceiver 当 LOW 数据 是 transferred 至 这
processsor 当 HIGH 这 处理器 places 写 数据 在 这 数据 bus
DEN 39 O 数据 使能 是 提供 作 一个 数据 总线 transceiver 输出 enable DEN 是
起作用的 低 在 各自 记忆 和 IO access DEN 是 高 whenever
DTR
改变 state 在 RESET DEN 是 驱动 高 为 一个 clock 然后
floated DEN
也 floats 在 HOLD
NOTE
管脚 names 在 parentheses 应用 至 这 80188
8
8

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8018680188 表格 1 管脚描述 (持续) 标识管脚类型名字和函数 No 支撑 50 I 支撑 indicates 那另一总线主控是 requesting 这 local bus 这支撑输入是起作用的 HIGH 支撑将是异步的和遵守至这 HLDA 51 O 处理器 clock 这处理器将公布一个 HLDA (高) 在回馈至一个支撑要求在这终止的 T 4 或者 T i  同时发生的和这 issuance 的 HLDA 这处理器将 float 这 local 总线和控制 lines 之后支撑是发现作正在 LOW 这处理器将更小的 HLDA 当这处理器 needs 至 run 另一总线 cycle 它将又一次驱动这 local 总线和控制 lines UCS 34 O Upper 记忆碎片选择是一个起作用的低输出 whenever 一个记忆涉及是制造至这定义 upper portion (1k–256K 块) 的 memory 这个线条是不 floated 在总线 HOLD 这地址范围 activating UCS 是软件 programmable LCS 33 O 更小的记忆碎片选择是起作用的低 whenever 一个记忆涉及是制造至这定义更小的 portion (1k–256k) 的 memory 这个线条是不 floated 在总线 HOLD 这地址范围 activating LCS 是软件 programmable MCS0 38 O mid-范围记忆碎片选择信号是起作用的低当一个记忆涉及是制造至这定义 mid-范围 portion 的记忆 (8k–512k) MCS1 37 O 这些线条是不 floated 在总线 HOLD 这地址范围 activating MCS2 36 O MCS0–3 是软件 programmable MCS3 35 O PCS0 25 O 附带的碎片选择信号 0–4 是起作用的低当一个涉及是制造至这定义附带的范围 (64 Kbyte IO 空间) 这些线条是不 PCS1 27 O floated 在总线 HOLD 这地址范围 activating PCS0–4 是 PCS2 28 O 软件 programmable PCS3 29 O PCS4 30 O PCS5A1 31 O 附带的碎片选择 5 或者 Latched A1 将是编写程序至提供一个 sixth 附带的碎片 select 或者至提供一个内部 latched A1 signal 这地址范围 activating PCS5 是软件-programmable PCS5A1 做不 float 在总线 HOLD 当编写程序至提供 latched A1 这个管脚将 retain 这先前 latched 值在 HOLD PCS6A2 32 O 附带的碎片选择 6 或者 Latched A2 将是编写程序至提供一个 seventh 附带的碎片 select 或者至提供一个内部 latched A2 signal 这地址范围 activating PCS6 是软件 programmable PCS6A2 做不 float 在总线 HOLD 当编写程序至提供 latched A2 这个管脚将 retain 这先前 latched 值在 HOLD DTR 40 O 数据 TransmitReceive 控制这方向的数据流动通过一个外部数据总线 transceiver 当 LOW 数据是 transferred 至这 processsor 当 HIGH 这处理器 places 写数据在这数据 bus DEN 39 O 数据使能是提供作一个数据总线 transceiver 输出 enable DEN 是起作用的低在各自记忆和 IO access DEN 是高 whenever DTR 改变 state 在 RESET DEN 是驱动高为一个 clock 然后 floated DEN 也 floats 在 HOLD NOTE 管脚 names 在 parentheses 应用至这 80188 8 8

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