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资料编号:124947
 
资料名称:ADuC841BS62-5
 
文件大小: 903.04K
   
说明
 
介绍:
MicroConverter 12-Bit ADCs and DACs with Embedded High Speed 62-kB Flash MCU
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
aduc841/aduc842/aduc843
rev. 0 | 页 7 的 88
1
温度 范围 –40°c 至 +85°c.
2
模数转换器 线性 是 有保证的 在 非rmal microconverter 核心 运作.
3
模数转换器 lsb 大小 = v
REF
/2
12
, i.e., 为 内部的 v
REF
= 2.5 v, 1 lsb = 610 µv, 和 为 外部 v
REF
= 1 v, 1 lsb = 244 µv.
4
这些 号码 是 不 生产 测试 但是 是 supported 用 设计 和/或者 描绘 数据 在 生产 释放.
5
补偿 和 增益 错误 和 补偿 和 增益 error 相一致 是 量过的 after 工厂 校准.
6
为基础 在 外部 模数转换器 系统 组件, 这 用户 将 需要 至 execute 一个 系统 校准 至 除去 额外的 外部 channel errors 至 达到 这些
规格.
7
snr 计算 包含 扭曲量 和 噪音 组件.
8
频道-至-频道 串扰 是 量过的 在 调整 途径.
9
这 温度 监控 给 一个 measure 的这 消逝 温度 直接地; 空气 温度 能 是 inferred 从 这个 结果.
10
dac 线性 是 计算 使用:
减少 代号 范围 的 100 至 4095, 0 v 至 v
REF
范围.
减少 代号 范围 的 100 至 3945, 0 v 至 v
DD
范围.
dac 输出 加载 = 10 kΩ 和 100 pf.
11
dac 差别的 非线性 指定 在 0 v 至 v
REF
和 0 v 至 v
DD
范围.
12
dac 规格 为 输出 阻抗 在这 unbuffered 情况 取决于 在 dac 代号.
13
dac 规格 为 i
下沉
, 电压 输出 安排好 时间, 和 数字的-至-相似物 glitch 活力 取决于 在 外部 缓存区 implementation 在 unbuffered 模式. dac 在
unbuffered 模式 测试 和 运算270 外部 缓存区, 这个 有一个 低 输入 泄漏 电流.
14
量过的 和 c
REF
管脚 decoupled 和 0.47 µf capacitor 至 地面. 电源-向上 时间 为 这 内部的 涉及 是 决定 用 这 值 的 这 decoupling 电容
选择 为 这 c
REF
管脚.
15
当 使用 一个 外部 涉及 设备, 这 内部的 带宽 间隙 涉及 输入 能 是 绕过 用 设置 这 adccon1.6 位.
16
flash/ee 记忆 reliability 特性 应用 至 两个都 这 flash/ee program 记忆 和 这 flash/ee 数据 记忆.
17
忍耐力 是 qualified 至 100,000循环 作 每 电子元件工业联合会 标准. 22 method a117 和 量过的 在 –40°c,+25°c, 和 +85°c. 典型 终止urance 在 25°c 是 700,000 循环.
18
保持 存在期 相等的 在 接合面 温度 (t
J
) = 55°c 作 每 电子元件工业联合会 标准. 22 方法 a117. 保持 存在期 based 在 一个 activation 活力 的0.6 ev derates
和 接合面 温度 作 显示 在 图示 38在 这 flash/ee 记忆可靠性 部分.
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电源 供应 电流 consumption 是 量过的 在 正常的,空闲, 和 电源-向下 模式 下面 这 下列的 情况:
正常的 模式: 重置 = 0.4 v, 数字的 i/o pins = 打开 电路, 核心 clk changed 通过 cd位 在 pllcon (一个duc842/aduc843), 核心 executing 内部的
软件 循环.
空闲 模式: 重置 = 0.4 v, 数字的 i/o 管脚 = 打开 电路, core clk changed 通过 cd 位 在pllcon (aduc842/aduc843), pcon.0 =1, 核心 执行
suspended 在 空闲 模式.
电源-向下 模式: 重置 = 0.4 v, 所有 端口 0 管脚 = 0.4 v, 所有 其它 数字的 i/o 和 端口 1 管脚 是 打开 circuit, 核心 clk changed 通过 cd 位 在 pllcon
(aduc842/aduc843), pcon.0 = 1, 核心 执行suspended 在 电源-向下 模式, osc 转变 在 或者 止 via osc_pd 位 (pllcon.7) 在
pllcon sfr (一个duc842/aduc843).
20
DV
DD
电源 供应 电流 增加 典型地 用 3 毫安 (3 v 运作) 和 10 毫安 (5 v operation) 在 一个 flash/ee 记忆 程序 或者擦掉 循环.
21
电源 供应 电流 是 生产 测试 在 5.25 v 和 3.3 v 为 一个 5 v 和 3 v 部分, 各自.
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