SN74AUP1T97YZPR_集成电路资料查询网

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sces613a – october2004 − 修订 12月 2004
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邮递 办公室 盒 655303
•
达拉斯市, 德州 75265
逻辑 配置
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B
Y
C
V
CC
B
一个
图示 5. 157: 2-至-1 数据 选择/mux
当 c 是 l, y = b
当 c 是 h, y = 一个
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一个
Y
C
V
CC
C
Y
一个
图示 6. 08: 2-输入 和 门
C
Y
B
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一个
Y
C
V
CC
C
Y
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图示 7. 14+32/14+00: 2-输入 或者/与非 门
和 一个 inverted 输入
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B
Y
C
V
CC
图示 8. 14+08/14+02: 2-输入 和/也不
门 和 一个 inverted 输入
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B
Y
C
V
CC
图示 9. 32: 2-输入 或者 门
C
Y
一个
C
Y
一个
C
Y
一个
地
地 地
C
Y
B
地
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C
V
CC
图示 10. 04/14: 反相器
YC
地
地
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Y
V
CC
图示 11. 17/34: noninverted 缓存区
YB
地
B

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           sces613a – october2004 − 修订 12月 2004 5 邮递办公室盒 655303 • 达拉斯市, 德州 75265 逻辑配置 1 2 3 6 5 4 B Y C V CC B 一个图示 5. 157: 2-至-1 数据选择/mux 当 c 是 l, y = b 当 c 是 h, y = 一个 1 2 3 6 5 4 一个 Y C V CC C Y 一个图示 6. 08: 2-输入和门 C Y B 1 2 3 6 5 4 一个 Y C V CC C Y B 图示 7. 14+32/14+00: 2-输入或者/与非门和一个 inverted 输入 1 2 3 6 5 4 B Y C V CC 图示 8. 14+08/14+02: 2-输入和/也不门和一个 inverted 输入 1 2 3 6 5 4 B Y C V CC 图示 9. 32: 2-输入或者门 C Y 一个 C Y 一个 C Y 一个地地地 C Y B 地 1 2 3 6 5 4 Y C V CC 图示 10. 04/14: 反相器 YC 地地 1 2 3 6 5 4 Y V CC 图示 11. 17/34: noninverted 缓存区 YB 地 B

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