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资料编号:216051
 
资料名称:CDC582
 
文件大小: 143.57K
   
说明
 
介绍:
3.3-V PHASE-LOCK LOOP CLOCK DRIVER WITH DIFFERENTIAL LVPECL CLOCK INPUTS
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
CDC582
3.3-v 阶段-锁 循环 时钟 驱动器
和 差别的 lvpecl 时钟 输入
scas446b – july 1994 – 修订 二月 1996
7
邮递 办公室 盒 655303
达拉斯市, 德州 75265
定时 (所需的)东西 在 推荐 范围 的 供应 电压 和 运行 自由-空气
温度
最小值 最大值 单位
f
lk
时钟 频率
vco 是 运行 在 四 时间 这 clkin/clkinfrequency25 50
MHzf
时钟
时钟 频率
vco 是 运行 在 翻倍 这 clkin/clkin
频率 50 100
MHz
输入 时钟 职责 循环 40% 60%
之后 sel1, sel0 50
stabilization 时间
之后 oe
50
µ
s
之后 电源 向上 50
时间 必需的 为 这 整体的 pll 电路 至 获得 阶段 锁 的 它的 反馈 信号 至 它的 涉及 信号. 为 阶段 锁 至 是 得到, 一个
fixed-频率, fixed-阶段 涉及 信号 必须 是 呈现 在 clkin. 直到 阶段 锁 是 得到, 这 规格 为 传播 延迟
和 skew 参数 给 在 这 切换 特性 表格 是 不 适用.
切换 特性 在 推荐 范围 的 供应 电压 和 运行 自由-空气
温度, c
L
= 15 pf (看 便条 4 和 计算数量 1, 2, 和 3)
参数
(输入)
(输出)
最小值 最大值 单位
职责 循环 Y 45% 55%
f
最大值
100 MHz
Jitter
(pk-pk)
CLKIN
Y
200 ps
t
阶段
错误
CLKIN
Y
–500 500 ps
t
sk(o)
Y 0.5 ns
t
sk(pr)
Y 1 ns
t
r
1.4 ns
t
f
1.4 ns
这 传播 延迟, t
阶段
错误
, 是 依赖 在 这 反馈 path 从 任何 输出 至 这 fbin. 这 t
阶段
错误
, t
sk(o)
, 和 t
sk(pr)
规格 是 仅有的 有效的 为 equal 加载 的 所有 输出.
便条 4: 这 规格 为 参数 在 这个 表格 是 适用 仅有的 之后 任何 适合的 stabilization 时间 有 消逝.
参数 度量 信息
从 输出
下面 测试
加载 电路 为 输出
t
阶段
错误
2 v
2.4 v
1.6 v
V
OH
V
OL
CLKIN
0.8 v
2 v
t
r
t
f
0.8 v
2 v
500
cl = 30 pf
(看 便条 一个)
电压 波形
传播 延迟 时间
输出
1.5 v
CLKIN
2 v
注释: 一个. C
L
包含 探查 和 jig 电容.
b. 这 输出 是 量过的 一个 在 一个 时间 和 一个 转变 每 度量.
c. 所有 输入 脉冲 是 有提供的 用 发生器 having 这 下列的 特性: prr
10 mhz, z
O
= 50
, t
r
2.5 ns, t
f
2.5 ns.
图示 1. 加载 电路 和 电压 波形
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