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cdp1871a, cdp1871ac
图示 1. 典型 cdp1800 序列 微处理器 系统 使用 这 cdp1871a
图示 2. cdp1871a 块 图解
0.1
µ
F
36
V
DD
100K
40
DEBOUNCE
cs1,
cs2,
CS3
CS4
TPB
变换
23
24
21
34
控制
ALPHA
39
控制
变换
38
bus0-bus7
控制
MRD
D11
D1
alpha 锁
正常的
V
DD
TPB
n0-n2
37
bus0-bus7
cdp1800-序列
CPU
CDP1871A
S1
12
S2
13
S3
14
S4
15
S5
16
S6
17
S7
18
S8
19
8 位 数据 总线
11
向上 至 11 sets
的 8 switches 各自
1
3225
CS1
CS2
CS3
21
22
23
24
34
CS4
TPB
CS
控制
逻辑
关键
发现
36
DEBOUNCE
C
X
R
X
V
DD
R
N
f/f
33
DA
35
RPT
状态
LATCHES
关键 向下
发现
1 的 8
MUXR
PD
R
PD
从
关键 板
12
19
SENSE
线条
1 11
至
关键 板
驱动
线条
DI DII
37
ALPHA
解码器/
驱动器
II
获得
39
变换
38
控制
R
PD
R
PD
三-平台
scan 计数器
five-平台
scan 计数器
c1-c3
c4-c8
三-状态
输出
缓存区
总线 使能
25
32
总线 0
总线 7
40
20
V
DD
V
SS
scan 时钟
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