CXD1803AQ_集成电路资料查询网

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cxd1803aq/ar
交流 特性
(v
DD
= 5 v±10%, v
SS
= 0 v, topr = –20 至 75°c, 输出 加载 = 50 pf)
这 值 在 parentheses 在 这 tables 为 v
DD
= 3.5 v, v
SS
= 0 v, topr = –20 至 75°c, 输出 加载 = 50 pf.
那些 没有 parentheses 为 v
DD
= 5 v±10% 和 3.5 v.
1. sub cpu 接口
(1) 读
便条) "&放大;" indicates "和".
(2) 写
A0
XRD
d7-0
XCS
Tsar
Tdrd
Tfrd
Trrl
Thar
Item 标识 最小值 典型值 最大值 单位
地址 建制 时间 (为 xcs &放大; xrd
↓
) Tsar 30 (70) ns
地址 支撑 时间 (为 xcs &放大; xrd
↑
) thar 20 (50) ns
数据 延迟 时间 (为 xcs &放大; xrd
↓
) Tdrd 60 (100) ns
数据 float 时间 (为 xcs &放大; xrd
↑
) Tfrd 0 15 (25) ns
低 水平的 xrd 脉冲波 宽度 Trrl 100 (150) ns
A0
XWR
d7-0
XCS
Tsaw
Tsdw
Thdw
Twwl
Thaw
Item 标识 最小值 典型值 最大值 单位
地址 建制 时间 (为 xcs &放大; xwr
↓
) Tsaw 30 (70) ns
地址 支撑 时间 (为 xcs &放大; xwr
↑
) Thaw 20 (50) ns
数据 建制 时间 (为 xcs &放大; xwr
↓
) Tsdw 40 (70) ns
数据 支撑 时间 (为 xcs &放大; xwr
↑
) Thdw 10 (30) ns
低 水平的 xwr 脉冲波 宽度 Twwl 50 (80) ns

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—9— cxd1803aq/ar 交流特性 (v DD = 5 v±10%, v SS = 0 v, topr = –20 至 75°c, 输出加载 = 50 pf) 这值在 parentheses 在这 tables 为 v DD = 3.5 v, v SS = 0 v, topr = –20 至 75°c, 输出加载 = 50 pf. 那些没有 parentheses 为 v DD = 5 v±10% 和 3.5 v. 1. sub cpu 接口 (1) 读便条) "&放大;" indicates "和". (2) 写 A0 XRD d7-0 XCS Tsar Tdrd Tfrd Trrl Thar Item 标识最小值典型值最大值单位地址建制时间 (为 xcs &放大; xrd ↓ ) Tsar 30 (70) ns 地址支撑时间 (为 xcs &放大; xrd ↑ ) thar 20 (50) ns 数据延迟时间 (为 xcs &放大; xrd ↓ ) Tdrd 60 (100) ns 数据 float 时间 (为 xcs &放大; xrd ↑ ) Tfrd 0 15 (25) ns 低水平的 xrd 脉冲波宽度 Trrl 100 (150) ns A0 XWR d7-0 XCS Tsaw Tsdw Thdw Twwl Thaw Item 标识最小值典型值最大值单位地址建制时间 (为 xcs &放大; xwr ↓ ) Tsaw 30 (70) ns 地址支撑时间 (为 xcs &放大; xwr ↑ ) Thaw 20 (50) ns 数据建制时间 (为 xcs &放大; xwr ↓ ) Tsdw 40 (70) ns 数据支撑时间 (为 xcs &放大; xwr ↑ ) Thdw 10 (30) ns 低水平的 xwr 脉冲波宽度 Twwl 50 (80) ns

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