D87C51_集成电路资料查询网

87C5180C51BH80C31BH
NOTES
1 ‘‘Typicals’’ 是 为基础 在 一个 限制 号码 的 样本 带去 从 early 制造 lots 和 是 不 guaranteed 这
值 列表 是 在 房间 temp 5V
2 电容的 加载 在 端口 0 和 2 将 导致 噪音 脉冲 在之上 04V 至 是 superimposed 在 这 V
OL
s 的 ALE 和
端口 1 2 和 3 这 噪音 是 预定的 至 外部 总线 电容 discharging 在 这 端口 0 和 端口 2 管脚 当 这些 管脚
改变 从 1 至 0 在 产品 在哪里 电容的 加载 超过 100 pF 这 噪音 脉冲 在 这些 信号 将 超过
08V 它 将 是 desirable 至 qualify ALE 或者 其它 信号 和 一个 施密特 Trigger 或者 cmos-水平的 输入 logic
3 电容的 加载 在 端口 0 和 2 将 导致 这 V
OH
在 ALE 和 PSEN 至 短促地 下降 在下 这 09V
CC
specifi-
cation 当 这 地址 位 是 stabilizing
4 看 计算数量 6 通过 8 为 I
CC
测试 conditions 最小 V
CC
为 电源 向下 是 2V
5 下面 稳步的 状态 (非-瞬时) conditions I
OL
必须 是 externally 限制 作 follows
最大 I
OL
每 端口 pin 10 毫安
最大 I
OL
每 8-位 port
端口 0 26 毫安
端口 1 2 和 3 15 毫安
最大 总的 I
OL
为 所有 输出 pins 71 毫安
如果 I
OL
超过 这 测试 condition V
OL
将 超过 这 related specification
管脚 是 不 有保证的 至 下沉 更好 比 这 列表 测试 conditions
272335–26
图示 5 87C51BH I
CC
vs 频率
10

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87C5180C51BH80C31BH NOTES 1 ‘‘Typicals’’ 是为基础在一个限制号码的样本带去从 early 制造 lots 和是不 guaranteed 这值列表是在房间 temp 5V 2 电容的加载在端口 0 和 2 将导致噪音脉冲在之上 04V 至是 superimposed 在这 V OL s 的 ALE 和端口 1 2 和 3 这噪音是预定的至外部总线电容 discharging 在这端口 0 和端口 2 管脚当这些管脚改变从 1 至 0 在产品在哪里电容的加载超过 100 pF 这噪音脉冲在这些信号将超过 08V 它将是 desirable 至 qualify ALE 或者其它信号和一个施密特 Trigger 或者 cmos-水平的输入 logic 3 电容的加载在端口 0 和 2 将导致这 V OH 在 ALE 和 PSEN 至短促地下降在下这 09V CC specifi- cation 当这地址位是 stabilizing 4 看计算数量 6 通过 8 为 I CC 测试 conditions 最小 V CC 为电源向下是 2V 5 下面稳步的状态 (非-瞬时) conditions I OL 必须是 externally 限制作 follows 最大 I OL 每端口 pin 10 毫安最大 I OL 每 8-位 port 端口 0 26 毫安端口 1 2 和 3 15 毫安最大总的 I OL 为所有输出 pins 71 毫安如果 I OL 超过这测试 condition V OL 将超过这 related specification 管脚是不有保证的至下沉更好比这列表测试 conditions 272335–26 图示 5 87C51BH I CC vs 频率 10

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