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资料编号:251811
 
资料名称:AD9842A
 
文件大小: 272.27K
   
说明
 
介绍:
Complete 20 MSPS CCD Signal Processors
 
 


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rev. 0
AD9841A/ad9842a
–12–
VD
HD
便条: 0 = gain0, 1 = gain1, 2 = gain2
线条 n 线条 n+1
012012012... 012012012......01201
图示 12. pxga 模式 3 (3-颜色) 框架/线条 增益 寄存器 sequence
SHP
HD
PxGA
增益
GAIN1
VD
GAIN2 GAIN0
GAIN1GAIN0
GAINXGAIN0GAINX
3ns 最小值
5 pixel 最小值
5 pixel 最小值
注释:
1. 两个都 vd 和 hd 是 内部 updated 在 shp rising edges.
2. 每 hd rising 边缘 和 一个 previous vd rising 边缘 将 重置 至 012012.
图示 13. pxga 模式 3 (3-颜色) 详细地 定时
VD
HD
便条: 0 = gain0, 1 = gain1, 2 = gain2, 3 = gain3
线条 n 线条 n+1
012301230123......0123001230123012...
图示 14. pxga 模式 4 (4-颜色) 框架/线条 增益 寄存器 sequence
SHP
HD
PxGA
增益
GAIN1
VD
GAIN2 GAIN0
GAIN1GAIN0
GAINXGAIN0GAINX
3ns 最小值
5 pixel 最小值
5 pixel 最小值
注释:
1. 两个都 vd 和 hd 是 内部 updated 在 shp rising edges.
2. 每 hd rising 边缘 和 一个 previous vd rising 边缘 将 重置 至 01230123.
图示 15. pxga 模式 4 (4-颜色) 详细地 定时
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