TDA7342_集成电路资料查询网

13
12
10
11
L1
L2
L3
L1
L2
L3
M
7
8
5
R1
R2
R3
R1
R2
R3
M
M
CD 地
6
输入
选择
+ 增益
LEFT
输入
CD
正确的
输入
供应
30 31 29
零
交叉
+
沉默的
软
沉默的
输出(l) 在(l)
16 15
LOUD+
VOL
零
交叉
+
沉默的
LOUD+
VOL
BASS
BASS
loud(l)
9
TREBLE
TREBLE
10
µ
FC9
314
csmout(r)cref 在(r)
24
loud(r)
bout(l)
bin(l)
18 17
bout(r) bin(r)
20 19 1
treble(r)
SPKR
ATT
沉默的
SPKR
ATT
沉默的
SPKR
ATT
沉默的
SPKR
ATT
沉默的
treble(l)
32
23
28
27
26
24
25
22
输出
LEFT FRONT
输出
LEFT 后部
SCL
SDA
DIGGND
输出
正确的 FRONT
输出
正确的 后部
D94AU104B
总线
串行 总线 解码器 + LATCHES
MONO 输入
C1
C2
C6
C3
C7
C8
C4
C5
C10
C12
47nF
CSM
47nF
C14
100nF
C15
100nF
4.7k
C16
2.7nf
C19 2.7nf
C18
100nF
C17 100nF
C13 47nF
C11
R2
4.7k
21
SM
V
S
R1
块 图解
TDA7342
2/14

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13 12 10 11 L1 L2 L3 L1 L2 L3 M 7 8 5 R1 R2 R3 R1 R2 R3 M M CD 地 6 输入选择 + 增益 LEFT 输入 CD 正确的输入供应 30 31 29 零交叉 + 沉默的软沉默的输出(l) 在(l) 16 15 LOUD+ VOL 零交叉 + 沉默的 LOUD+ VOL BASS BASS loud(l) 9 TREBLE TREBLE 10 µ FC9 314 csmout(r)cref 在(r) 24 loud(r) bout(l) bin(l) 18 17 bout(r) bin(r) 20 19 1 treble(r) SPKR ATT 沉默的 SPKR ATT 沉默的 SPKR ATT 沉默的 SPKR ATT 沉默的 treble(l) 32 23 28 27 26 24 25 22 输出 LEFT FRONT 输出 LEFT 后部 SCL SDA DIGGND 输出正确的 FRONT 输出正确的后部 D94AU104B 总线串行总线解码器 + LATCHES MONO 输入 C1 C2 C6 C3 C7 C8 C4 C5 C10 C12 47nF CSM 47nF C14 100nF C15 100nF 4.7k C16 2.7nf C19 2.7nf C18 100nF C17 100nF C13 47nF C11 R2 4.7k 21 SM V S R1 块图解 TDA7342 2/14

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