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资料编号:316376
 
资料名称:74F675APC
 
文件大小: 63.15K
   
说明
 
介绍:
16-Bit Serial-In, Serial/Parallel-Out Shift Register
 
 


: 点此下载
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74F675A
单位 加载/风扇 输出
函数的 描述
这 16-位 变换 寄存器 运作 在 一个 的 四 模式, 作
决定 用 这 信号 应用 至 这 碎片 选择 (cs
),
读/写 (r/w
) 和 store 时钟 脉冲波 (stcp) 输入.
状态 改变 是 表明 用 这 下落 边缘 的 这 变换
时钟 脉冲波 (shcp
D
0
从 这 串行 输入 (si) 管脚 和 exits 从 q
15
通过 这
串行 数据 输出 (所以) 管脚. 在 这 并行的 加载 模式,
数据 从 这 存储 寄存器 输出 enter 这 变换 regis-
ter 和 串行 shifting 是 inhibited.
这 存储 寄存器 是 在 这 支撑 模式 当 也 cs
或者
r/w
是 高. 和 cs和 r/w两个都 低, 这 存储
寄存器 是 并行的 承载 从 这 变换 寄存器 在 这 ris-
ing 边缘 的 stcp.
至 阻止 false clocking 的 这 变换 寄存器, shcp
应当
是 在 这 低 状态 在 一个 低-至-高 转变 的
CS
. 至 阻止 false clocking 的 这 存储 寄存器, stcp
应当 是 低 在 一个 高-至-低 转变 的 cs
如果
r/w
是 低, 和 应当 也 是 低 在 一个 高-至-
低 转变 的 r/w
如果 cs是 低.
变换 寄存器 行动 表格 存储 寄存器 行动 表格
H
=
高 电压 水平的
L
=
低 电压 水平的
X
=
不重要
=
高-至-低 转变
=
低-至-高 转变
逻辑 图解
请 便条 那 这个 图解 是 提供 仅有的 为 这 understanding 的 逻辑 行动 和 应当 不 是 使用 至 估计 传播 延迟.
管脚 names 描述
u.l.
输入 i
IH
/i
IL
高/低
输出 i
OH
/i
OL
SI 串行 数据 输入 1.0/1.0 20
µ
一个/
0.6 毫安
CS
碎片 选择 输入 (起作用的 低) 1.0/1.0 20
µ
一个/
0.6 毫安
SHCP
变换 时钟 脉冲波 输入 (起作用的 下落 边缘) 1.0/1.0 20
µ
一个/
0.6 毫安
STCP store 时钟 脉冲波 输入 (起作用的 rising 边缘) 1.0/1.0 20
µ
一个/
0.6 毫安
r/w
读/写 输入 1.0/1.0 20
µ
一个/
0.6 毫安
所以 串行 数据 输出 50/33.3
1 毫安/20 毫安
Q
0
–Q
15
并行的 数据 输出 50/33.3
1 毫安/20 毫安
控制 输入 运行
CS
r/w SHCP STCP 模式
H X X X 支撑
LL
X 变换 正确的
LH
L 变换 正确的
LH
H 并行的 加载,
非 shifting
输入 运行
CS
r/w STCP 模式
HXXHold
LHXHold
LL
并行的 加载
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