july 1998
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7.20.98
4.1 音频的 pll 时钟 发生率 (aclk)
这 aclk 频率 是 控制 用 寄存器 位 d[0],
d[1], 和 d[2] accessed 通过 这 串行 接口. 这
aclk 发生率 列表 在下 是 获得 通过 这 pll
分隔物 比率 从 一个 涉及 频率 的 27mhz.
表格 3: aclk 频率 选择
D[2] D[1] D[0]
pll 分隔物
比率
音频的
OVERSAMPLING
ACLK
(mhz)
0 0 0 1024 / 2250 48khz x 256 12.288
0 0 1 1024 / 3375 32khz x 256 8.192
0 1 0 1024 / 4500 48khz x 256 / 2 6.144
0 1 1 1024 / 6750 32khz x 256 / 2 4.096
1 0 0 1568 / 3750 44.1khz x 256 11.2896
1 0 1 1568 / 2500 44.1khz x 384 16.9344
1 1 0 1568 / 7500 44.1khz x 256 / 2 5.6448
1 1 1 1024 / 1125 48khz x 512 24.576
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4.2 音频的 时钟 止-速 发生率
这 aclk 发生率 显示 将 是 smoothly 修改
至 一个 slightly 高等级的 或者 更小的 值 下面 寄存器 控制.
寄存器 位 d[3] 必须 是 一个 逻辑-一个 至 活动 这个
模式. 这 值 的 d[4] 控制 whether 这 频率
将 是 调整 slightly 低 (d[4] = 0) 或者 高 (d[4] = 1).
表格 4: 音频的 止 速 发生率
D[4] D[3] D[2] D[1] D[0]
pll 分隔物
比率
ACLK
(mhz)
010001023 / 2250 12.276
010011023 / 3375 8.184
010101023 / 4500 6.138
010111023 / 6750 4.092
011001567 / 3750 11.2824
011011567 / 2500 16.9236
011101567 / 7500 5.6412
011111023 / 1125 24.5520
110001025 / 2250 12.3000
110011025 / 3375 8.2000
110101025 / 4500 6.1500
110111025 / 6750 4.1000
111001569 / 3750 11.2968
111011569 / 2500 16.9432
111101569 / 7500 5.6484
111111025 / 1125 24.6000
4.3 utility pll 时钟 发生率 (uclk)
这 uclk 频率 是 控制 用 寄存器 位 d[5],
d[6] 和 d[7], accessed 通过 这 串行 接口. uclk
发生率 列表 在下 是 获得 通过 这 pll 分隔物
比率 从 一个 涉及 频率 的 27mhz.
表格 5: uclk 频率 选择
D[7] D[6] D[5] pll 分隔物 比率 uclk (mhz)
0 0 0 16 / 27 16.0000
0 0 1 35 / 33 28.6363
0 1 0 1568 / 3750 11.2896
0 1 1 1 27.0000
1 0 0 544 / 375 39.1680
1 0 1 728 / 375 52.4160
1 1 0 10 / 9 30.0000
1 1 1 1024 / 1125 24.5760
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4.4 处理器 pll 发生率 (pclk)
这 pclk 频率 是 控制 用 这 逻辑 水平 在
这 psel0 和 psel1 输入. 这些 输入 有 弱
拉-downs. pclk 发生率 列表 在下 是 获得
通过 这 pll 分隔物 比率 从 一个 涉及 频率 的
27mhz.
表格 6: pclk 频率 选择
PSEL1 PSEL0 pll 分隔物 比率 pclk (mhz)
0 0 32 / 27 32.0000
0 1 40 / 27 40.0000
1 0 50 / 27 50.0000
1 1 60 / 41 39.5122
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