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资料编号:42591
 
资料名称:CY7C68013A-100AXC
 
文件大小: 1958.79K
   
说明
 
介绍:
EZ-USB FX2LP USB Microcontroller
 
 


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cy7c68013a/cy7c68014a
cy7c68015a/cy7c68016a
文档 #: 38-08032 rev. *g 页 11 的 55
3.12.5 default 全部-速 alternate settings
3.12.6 default 高-速 alternate settings
3.13 外部 先进先出 接口
3.13.1 Architecture
这 fx2lp 从动装置 先进先出 architecture 有 第八 512-字节 blocks
在 这 endpoint 内存 那 直接地 提供 作 先进先出 memories,
和 是 控制 用 先进先出 控制 信号 (此类 作 ifclk,
slcs#, slrd, slwr, sloe, pktend, 和 flags).
在 运作, 一些 的 这 第八 内存 blocks fill 或者 empty 从
这 sie, 当 这 其他 是 连接 至 这 i/o 转移
逻辑. 这 转移 逻辑 takes 二 形式, 这 gpif 为 内部
发生 控制 信号, 或者 这 从动装置 先进先出 接口 为
externally 控制 transfers.
3.13.2 主控/从动装置 控制 信号
这 fx2lp endpoint fifos 是 执行 作 第八 physi-
cally distinct 256x16 内存 blocks. 这 8051/sie 能 转变
任何 的 这 内存 blocks 在 二 domains, 这 usb (sie)
domain 和 这 8051-i/o 单位 domain. 这个 切换 是 完毕
virtually instantaneously, 给 essentially 零 转移 时间
在 “usb fifos” 和 “slave fifos.” 自从 它们 是
physically 这 一样 记忆, 非 字节 是 的确 transferred
在 缓存区.
在 任何 给 时间, 一些 内存 blocks 是 filling/emptying 和
usb 数据 下面 sie 控制, 当 其它 内存 blocks 是
有 至 这 8051 和/或者 这 i/o 控制 单位. 这 内存
blocks 运作 作 单独的-端口 在 这 usb domain, 和 双-
端口 在 这 8051-i/o domain. 这 blocks 能 是 配置 作
单独的, 翻倍, triple, 或者 四方形 缓冲 作 先前 显示.
这 i/o 控制 单位 实现 也 一个 内部的-主控 (m
为 主控) 或者 外部-主控 (s 为 从动装置) interface.
在 主控 (m) 模式, 这 gpif 内部 控制
fifoadr[1..0] 至 选择 一个 先进先出. 这 rdy 管脚 (二 在 这 56-
管脚 包装, 六 在 这 100-管脚 和 128-管脚 包装) 能 是
使用 作 标记 输入 从 一个 外部 先进先出 或者 其它 逻辑 如果
desired. 这 gpif 能 是 run 从 也 一个 内部 获得
时钟 或者 externally 有提供的 时钟 (ifclk), 在 一个 比率 那
transfers 数据 向上 至 96 megabytes/s (48-mhz ifclk 和 16-
位 接口).
在 从动装置 (s) 模式, 这 fx2lp accepts 也 一个 内部
获得 时钟 或者 externally 有提供的 时钟 (ifclk, 最大值
频率 48 mhz) 和 slcs#, slrd, slwr, sloe,
pktend 信号 从 外部 逻辑. 当 使用 一个 外部
ifclk, 这 外部 时钟 必须 是 呈现 在之前 切换 至
这 外部 时钟 和 这 ifclksrc 位. 各自 endpoint 能
individually 是 选择 为 字节 或者 文字 运作 用 一个
内部的 配置 位, 和 一个 从动装置 先进先出 输出 使能
信号 sloe 使能 数据 的 这 选择 宽度. 外部 逻辑
必须 insure 那 这 输出 使能 信号 是 inactive 当
writing 数据 至 一个 从动装置 先进先出. 这 从动装置 接口 能 也
运作 asynchronously, 在哪里 这 slrd 和 slwr 信号
act 直接地 作 strobes, 相当 比 一个 时钟 qualifier 作 在
同步的 模式. 这 信号 slrd, slwr, sloe 和
pktend 是 gated 用 这 信号 slcs#.
表格 3-6. default 全部-速 alternate settings
[4, 5]
alternate 设置 0 1 2 3
ep0 64 64 64 64
ep1out 0 64 大(量) 64 int 64 int
ep1in 0 64 大(量) 64 int 64 int
ep2 0 64 大(量) 输出 (2×) 64 int 输出 (2×) 64 iso 输出 (2×)
ep4 0 64 大(量) 输出 (2×) 64 大(量) 输出 (2×) 64 大(量) 输出 (2×)
ep6 0 64 大(量) 在 (2×) 64 int 在 (2×) 64 iso 在 (2×)
ep8 0 64 大(量) 在 (2×) 64 大(量) 在 (2×) 64 大(量) 在 (2×)
注释:
4. “0” 意思 “not 执行.”
5. “2×” 意思 “double 缓冲.”
6. 甚至 though 这些 缓存区 是 64 字节, 它们 是 reported 作 512 为 usb 2.0 遵从. 这 用户 必须 从不 转移 packets大 比 64 字节 至 ep1.
表格 3-7. default 高-速 alternate settings
[4, 5]
alternate 设置 0 1 2 3
ep0 64 64 64 64
ep1out 0 512 大(量)
[6]
64 int 64 int
ep1in 0 512 大(量)
[6]
64 int 64 int
ep2 0 512 大(量) 输出 (2×) 512 int 输出 (2×) 512 iso 输出 (2×)
ep4 0 512 大(量) 输出 (2×) 512 大(量) 输出 (2×) 512 大(量) 输出 (2×)
ep6 0 512 大(量) 在 (2×) 512 int 在 (2×) 512 iso 在 (2×)
ep8 0 512 大(量) 在 (2×) 512 大(量) 在 (2×) 512 大(量) 在 (2×)
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