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资料编号:458011
 
资料名称:LX1686CPW
 
文件大小: 139.01K
   
说明
 
介绍:
Digital Dimming CCFL Controller IC
 
 


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





LX1686

3










(持续)
参数
标识
测试 情况 单位
LX1686
最小值 典型值 最大值
数字的 dimmer 块
fvert 输入 频率 俘获 范围 F
r_fvert
fvert 逻辑 门槛 V
th_fvert
设计 涉及 仅有的
fvert 输入 阻抗 R
FVERT
设计 涉及 仅有的
vco 相似物 输出 顶峰 电压 V
p_vco
vco 相似物 输出 valley 电压 V
v_vco
vco 强迫 源 电流 F
r_vco_i_src
V
pd_cr
= 3v, vdd = 3v
强迫 vco 振动 频率 F
x_vco
afc_c = 0v, c
VCO
= 0.01µf
自动-频率 发现 回馈 T
d_afd
fvert 频率 是 200hz, vdd = 3v
brite 电压 范围 V
r_brite
全部-明亮 brite 输入 电压 V
brite_全部
V
brt_pos
= vdd 或者 float; brite = 2.5v
V
brt_pos
= 0v, brite = 0.5v
全部-darkness brite 输入 电压 V
brite_dark
V
brt_pos
= vdd 或者 float brite = 0.5v
V
brt_pos
= 0v, brite = 2.5v
d_brite
brite_pos 逻辑 门槛
dig_dim 逻辑 门槛
40 200 Hz
vdd/2 V
50 k
2.5 V
0.65 V
-6.4 -5.8 -5.2 µA
250 Hz
1000 ms
0 VDD V
2.35 2.5 2.65 V
2.35 2.5 2.65 V
0.35 0.5 0.65 V
0.35 0.5 0.65 V
300 ns
vdd/2 V
vdd/2 V
直接 驱动 pwm 块
isns 门槛 电压 范围 V
r_isns
dig_dim = vdd
vamp 跨导 G
m_vamp
vcomp = 1.25v
vamp 输出 源 电流 I
s_vamp
vcomp = 1.5v
vamp 输出 下沉 电流 I
sk_vamp
vcomp = 1.5v
vamp 输出 电压 范围 V
r_vamp
vsns 门槛 电压 V
th_vsns
vcomp = vsns
vcomp 释放 电流 I
d_vcomp
vcomp = 0.5v, vdd = 3v
iamp 跨导 G
m_iamp
brite = 0.5 - 2.6v
iamp 输出 源 电流 I
s_iamp
icomp = 1.5v, vdd = 3v
iamp 输出 下沉 电流 I
sk_iamp
icomp = 1.5v, vdd = 3v
iamp 输出 电压 范围 V
r_iamp
iamp 输入 补偿 电压 T
SS
C
VCOMP
= 1µf
vcmp 输入 补偿 电压 V
os_vcmp
vcomp = 1.25v, vdd = 3v
vcomp-至-输出 传播 延迟 T
d_vcomp
vdd = 3v
icmp 输入 补偿 电压 V
os_icmp
icomp = 0.5 至 2.25v, vdd = 3v
icomp-至-输出 传播 延迟 T
d_icomp
brite = 1.25v, ramp_c = 2v, vdd = 3v
02.5v
400 µmho
10 50 110 µA
20 70 120 µA
0 VDD V
1.12 1.25 1.38 V
0.8 1.5 10 毫安
70 200 700 µmho
-15 -40 -80 µA
20 60 100 µA
0 VDD V
40 ms
-10 3 10 mV
250 500 ns
-10 3 10 mV
1100 ns
输出 缓存区 块
输出 下沉 电流 I
sk_outbuf
aout, bout = vdd = 3v
aout, bout = 1v, vdd = 3v
输出 源 电流 I
s_outbuf
aout, bout = 0v, vdd = 3v
aout, bout = 2v, vdd = 3v
25 45 80 毫安
20 35 55 毫安
-35 -50 -80 毫安
-20 -40 -55 毫安
偏差 控制 块
电压 在 管脚 i_r V
IR
管脚 i_r 最大 源 电流 I
最大值_ir
设计 涉及 仅有的
vbg 输出 阻抗 R
o_vbg
设计 涉及 仅有的
使能 逻辑 门槛 - 3v V
EN3V
vdd = 3v
使能 逻辑 门槛 - 5.5v V
en5.5
vdd = 5.5v
使能 门槛 hysteresis - 3v V
h_en3
使能 门槛 hysteresis - 5.5v V
h_en5.5
0.98 1.02 V
50 µA
10 k
1.5 1.9 2.4 V
2.7 3.2 3.6 V
0.45 V
350 mV
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