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资料编号:464667
 
资料名称:AM79212
 
文件大小: 501.08K
   
说明
 
介绍:
Advanced Subscriber Line Interface Circuit
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
aslic/aslac 产品 11
IDC 输出 直流 循环 控制 电流. 这 idc 输出 供应 一个 电流 至 这 aslic 设备 为 pro-
portional 控制 的 这 直流 循环 电流 流 通过 这 subscriber 循环.
IDIF 输入 纵向的 sense. idif 是 一个 电流 输入 管脚 喂养 用 这 idif 管脚 的 这 aslic 设备.
这 电流 在 这个 管脚 是 使用 用 这 aslac 设备 为 supervisory 和 diagnostic func-
tions. 这 idif 管脚 有 一个 内部的 输入 阻抗 所以 一个 外部 纵向的 噪音 过滤
电容 能 是 连接.
INT
输出, 起作用的
中断. 一个 逻辑 0 在 这个 管脚 indicates 一个 或者 更多 的 这 位 在 这 signaling 寄存器
有 changed states. 一个 中断 将 是 发生 当 activity 是 sensed 在 任何 信号
在 这 signaling 寄存器 不 masked 用 这 掩饰 寄存器. once 一个 unmasked activity
是 sensed, 这 int
输出 将 是 驱动 低 和 使保持 在 那 状态 直到 cleared. 看 这
描述 的 配置 寄存器 6 为 运作.
i/o
1
, i/o
2
, i/o
3
,
i/o
4
输入/输出 控制 端口. 这些 控制 线条 是 ttl 兼容 和 各自 能 是 编写程序 作
一个 输入 或者 一个 输出. 当 编写程序 作 输入, 它们 能 监控 外部, ttl com-
patible 逻辑 电路. 当 编写程序 作 输出, 它们 能 控制 一个 外部 逻辑 de-
恶行 或者 它们 能 是 连接 至 管脚 c3, c4, 或者 c5 的 这 aslic 设备 至 控制 测试
接转 驱动器 ry1out, ry2out 和 ry3out (i/o
3
, i/o
4
, 44-管脚 plcc 版本 仅有的). 在
这 输出 模式, 这些 管脚 是 控制 用 这 i/o
1
, i/o
2
, i/o
3
, 和 i/o
4
位 在 这
频道 控制 寄存器, mpi command 17.
IREF 涉及 电流 涉及. 一个 外部 电阻 (rref) 连接 在 这个 管脚 和 相似物
地面 发生 一个 精确 在-碎片 涉及 电流. 这个 电流 是 使用 用 这
aslac 设备 在 它的 直流 喂养 和 循环-supervision 电路.
irta, irtb 输入 环绕 trip sense. 这些 管脚 是 电流 summing nodes 关联 至 vref. 它们 pro-
vide terminations 为 外部 电阻器 rsr1 和 rsr2, 这个 sense 这 电压 在
两个都 sides 的 这 ringing 喂养 电阻 连接 至 这 环绕 总线. 至 决定 这 环绕-
ing 电流 在 这 循环, 这 aslac 设备 senses 这 区别 在 这 电流
在 这些 管脚.
ISUM 输入 metallic sense. isum 是 一个 电流 输入 管脚 和 是 喂养 用 这 isum 管脚 的 这 aslic de-
恶行. 这 绝对 值 的 这 电流 在 这个 管脚 是 使用 用 这 aslac 设备 为 超级的-
visory 和 diagnostic 功能.
MCLK 输入 主控 时钟. 这 主控 时钟 是 使用 至 运作 这 数字的 信号 处理器. mclk
能 是 2.048 mhz, 4.096 mhz 或者 8.192 mhz. mclk 将 是 异步的 至 pclk.
在之上 initialization, 这 mclk 输入 是 无能 和 相关的 电路系统 是 驱动 用 一个
连接 至 pclk. 这 mclk 连接 将 是 reestablished 下面 用户 控制.
PCLK 输入 pcm 时钟. 这 pcm 时钟 确定 这 比率 在 这个 pcm 数据 是 serially shifted 在
或者 输出 的 这 pcm 端口. pclk 是 一个 integer 多样的 的 这 框架 同步 频率. 这
最大 时钟 频率 是 8.192 mhz 和 这 最小 时钟 频率 是 128 khz 为
companded 数据. 这 最小 时钟 频率 为 直线的 或者 companded 数据 加 sig-
naling 数据 是 256 khz. 这 pclk 时钟 将 是 异步的 至 mclk 如果 这 最初的 con-
nection 状态 是 无能 下面 用户 控制.
RST
输入, 起作用的
重置. 一个 逻辑 0 在 这个 管脚 resets 这 aslac 设备 至 最初的 default 情况. 它 是
相等的 至 一个 硬件 重置 command. 一个 信号 较少 比 100 ns 应当 不 导致
一个 重置. 至 确保 恰当的 重置, 这 最小 长度 的 一个 重置 脉冲波 是 50 µs.
TSCA
, tscb 打开 流
输出
时间 slot 控制. 这 时间 slot 控制 输出 是 打开 流 (需要 一个 外部
拉-向上 电阻 至 vccd) 和 是 正常情况下 inactive (高 阻抗). tsca
是 起作用的
(低) 当 pcm 数据 是 呈现 在 dxa, 和 tscb
是 起作用的 (低) 当 pcm 数据 是
呈现 在 dxb. (tscb
和 drb
44-管脚 plcc 仅有的.)
VCCA 电源 相似物 电源 供应. vcca 是 内部 连接 至 基质 near 这 相似物 i/o
部分.
VCCD 电源 数字的 电源 供应. vccd 是 内部 连接 至 基质 near 这 数字的 部分.
VIN 输入 相似物 输入. 这 相似物 输出 (vtx) 从 这 aslic 设备 是 应用 至 这 aslac
设备 transmit path 输入, vin. 这 信号 是 抽样, processed, encoded, 和 trans-
mitted 在 这 pcm highway.
管脚 names 类型 描述
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