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资料编号:469291
 
资料名称:MACH435-15JC
 
文件大小: 254.58K
   
说明
 
介绍:
High-Density EE CMOS Programmable Logic
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
9mach435-12 (com’l)
切换 特性 在
商业的 运行 范围 (便条 1)
参数
标识 参数 描述 最小值 最大值 单位
t
PD
输入, i/o, 或者 反馈 至 combinatorial 输出 3 12 ns
建制 时间 从 输入, i/o, 或者 d-类型 5 ns
t-类型 6 ns
t
HA
寄存器 数据 支撑 时间 使用 产品 期 时钟 5 ns
t
COA
产品 期 时钟 至 输出 4 14 ns
t
WLA
8 ns
t
WHA
8 ns
d-类型 52.6 MHz
t-类型 50 MHz
d-类型 58.8 MHz
t-类型 55.6 MHz
62.5 MHz
t
SS
d-类型 7 ns
t-类型 8 ns
t
HS
寄存器 数据 支撑 时间 使用 global 时钟 0 ns
t
COS
global 时钟 至 输出 2 8 ns
t
WLS
6 ns
t
WHS
6 ns
d-类型 66.7 MHz
t-类型 62.5 MHz
f
MAXS
d-类型 83.3 MHz
t-类型 76.9 MHz
83.3 MHz
t
SLA
建制 时间 从 输入, i/o, 或者 反馈 至 5 ns
产品 期 时钟
t
HLA
获得 数据 支撑 时间 使用 产品 期 时钟 5 ns
t
GOA
产品 期 门 至 输出 16 ns
t
GWA
产品 期 门 宽度 低 (为 低 transparent) 6 ns
或者 高 (为 高 transparent)
t
SLS
建制 时间 从 输入, i/o, 或者 反馈 至 global 门 8 ns
t
HLS
获得 数据 支撑 时间 使用 global 门 0 ns
t
GOS
门 至 输出 10 ns
t
GWS
global 门 宽度 低 (为 低 transparent) 6 ns
或者 高 (为 高 transparent)
t
PDL
输入, i/o, 或者 反馈 至 输出 通过
transparent 输入 或者 输出 获得 14 ns
t
SIR
输入 寄存器 建制 时间 2 ns
t
HIR
输入 寄存器 支撑 时间 3 ns
t
ICO
输入 寄存器 时钟 至 combinatorial 输出 18 ns
外部 反馈
内部的 反馈 (f
CNTA
)
非 反馈 (便条 3)
global 时钟 宽度
反馈 至 产品 期 时钟
-12
t
SA
f
MAXA
产品 期, 时钟 宽度
最大 频率
使用 产品 期
时钟 (便条 2)
外部 反馈
建制 时间 从 输入, i/o, 或者 反馈
至 global 时钟
内部的 反馈 (f
CNTA
)
非 反馈 (便条 3)
最大 频率
使用 global
时钟 (便条 2)
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