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uart 定时 描绘
所有 参数 列表 在 这个 表格 是 laboratory bench 典型 在 房间 温度 在 一个 小 样本 的 部分. 非 保证 是 暗指. 这 主要的 intent
here 是 至 clarify 函数的 运作 的 这 82c52.
82c52 uart 定时
典型 和 ix = 外部 时钟
标识 参数 最小值 最大值 单位 测试 情况
(15) TS1 co(ix) 延迟 从 ix - 30 ns brsr 位 d7 = 0
(ix 输出)
(16) TS2 co (brg) 延迟 从 ix - 80 ns brsr 位 d7 = 1
(brg 输出)
(17) TCY co (brg) 时钟 循环 时间 62.5 - ns brsr 位 d7 = 1
(brg 输出), 便条 1
(18) TDTX sdo 延迟 从 co(brg) 低 - 30 ns 便条 2
(19) TWLTL wr 低 至 tbre 低 - 50 ns 便条 3
(20) TCLTH co (brg) 低 至 tbre 高 - 50 ns 注释 3, 4
(21) TIHF intr 高 在 标记 - 50 ns 便条 5a, 5b
(22) TIHM intr 高 在 ms - 50 ns 便条 5
(23) TRLIL rd 低 至 intr 低 - 60 ns
(24) TCTHX cts 高 至 使不能运转 transmit 4tcy + 10 - ns tbr 全部, 便条 6
(25) TDRH co (brg) 低 至 dr 高 - 40 ns 便条 7
(26) TRLDL rd 低 至 dr 低 - 50 ns 便条 7
(27) TWHO wr 高 至 rts/dtr 起作用的 - 50 ns
注释:
1. 预分频器 比率 的 分隔 用 1, divisor 选择 比率 的 “external” (分隔 用 1). 这 波特 比率 时钟 (co-brg) 运作 在 16 时间 这
用户 编写程序 位 比率. 为 例子, 在 1200 波特: tcy = 1/(16 x 1200) = 52.1
µ
s.
2. 一个. 和 tr (传输者 寄存器) initially empty, tdtx occurs 从 这 5th 下落 边缘 的 co(brg) 之后 wr 变得 高.
b. 和 tr initially 全部, tdtx occurs 从 这 trailing 边缘 的 这 16th co(brg) 在 这 last 停止 位 提供 wr went 高 用 这
trailing 边缘 的 这 12th co(brg) 在 这 last 停止 位.
c. 和 cts 高 (使不能运转 transmit) 和 tbr 全部, tdtx occurs 从 这 5th 下落 边缘 的 co(brg) 之后 cts 变得 低.
3. tbre 位 d6 在 usr 是 updated 各自 时间 tbre 改变 状态.
4. 一个. 和 tr initially empty, tclth(tbre) occurs 从 这 4th 下落 边缘 的 co(brg) 之后 wr 变得 高.
b. 和 tr initially 全部, tclth(tbre) occurs 从 这 trailing 边缘 的 这 15th co(brg) 在 这 last 停止 位 提供 wr went 高
用 这 trailing 边缘 的 这 12th co(brg) 在 这 last 停止 位.
c. 和 cts 高 (使不能运转 transmit) 和 tbr 全部, tclth(tbre) occurs 从 这 4th 下落 边缘 的 co(brg) 之后 cts 变得 低.
5. 一个. int 在 tc: inten 使能; usr 位 d5(tc) 是 updated 在 这个 时间 regardless 的 中断 配置.
- int 在 tc occurs 从 这 trailing 边缘 的 这 11th co(brg) 在 这 last 停止 位 如果 tbr empty 在 那 时间.
b. intr 在 receive flags oe, fe, pe, 和 rbrk: inten enabled; 各自的 usr 位 updated 在 这个 时间 regardless 的 中断
配置.
- int 在 oe, fe, pe, rbrk occurs 从 这 trailing 边缘 的 这 11th co(brg) 在 这 last 停止 bit. 至 避免 oe, rd(rbr) 必须
go 低 用 这 trailing 边缘 的 这 8th co(brg) 在 这 last 停止 位.
c. intr 在 ms: inten 和 mien 使能; usr 位 d4(ms) 是 updated 在 这个 时间 regardless 的 inten/mien.
- intr 在 ms occurs whenever cts 或者 dsr 输入 改变 状态.
6. tcthx 是 时间 在之前 终止 的 last 停止 位 用 这个 cts 必须 是 inactive (高) 至 阻止 传递 的 这 character waiting 在 tbr.
7. dr 位 d7 在 usr 是 updated 各自 时间 dr 改变 状态. tdrh 总是 从 trailing 边缘 的 11th co(brg) 在 last 停止 位.
82C52
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