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资料编号:491521
 
资料名称:MT9075AL
 
文件大小: 1008.52K
   
说明
 
介绍:
E1 Single Chip Transceiver
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
MT9075A
初步的 信息
4-132
17 90 VSS 负的 电源 供应 (输入).
数字的 地面.
18 91 IC 内部的 连接.
系 至 v
SS
(地面) 为 正常的 运作.
19 92 int/moT intel/motorola 模式 选择 (输入).
一个 高 在 这个 管脚 configures 这 处理器
接口 为 这 intel 并行的 非-多路复用 总线 类型. 一个 低 configures 这 处理器
接口 为 这 motorola 并行的 非-多路复用 类型.
20 93 VDD 积极的 电源 供应 (输入).
数字的 供应 (+5v
±
5%).
21 -
24
94-
97
d4 - d7 数据 4 至 数据 7 (三-状态 i/o).
这些 信号 联合的 和 d0-d3 表格 这
双向的 数据 总线 的 这 微处理器 接口 (d7 是 这 大多数 significant 位).
25 98 r/w/WR 读/写/写 strobe (输入).
在 motorola 模式 (r/w), 这个 输入 控制 这 方向 的 这 数据 总线 d[0:7] 在
一个 微处理器 进入. 当 r/w 是 高, 这 并行的 处理器 是 读 数据
从 这 mt9075a. 当 低, 这 微处理器 是 writing 数据 至 这 mt9075a.
为 intel 模式 (wr), 这个 起作用的 低 写 strobe configures 这 数据 总线 线条 作
输出.
26 -
30
99,
8-11
ac0 -
AC4
地址/控制 0 至 4 (输入).
地址 和 控制 输入 为 这 微处理器
接口. ac0 是 这 least significant 输入.
31 12 GNDARx receive 相似物 地面 (输入).
相似物 地面 为 这 liu 接受者.
32
33
13
14
RTIP
RRING
receive tip 和 环绕 (输入).
差别的 输入 为 这 receive 线条 信号 - 必须 是
变压器 结合 (看 图示 4).
34 15 VDDARx receive 相似物 电源 供应 (输入).
相似物 供应 为 这 liu 接受者 (+5v
±
5%).
35 16 VDD 积极的 电源 供应 (输入).
数字的 供应 (+5v
±
5%).
36 17 VSS 负的 电源 供应 (输入).
数字的 地面.
37 18 IC 内部的 连接.
必须 是 left 打开 为 正常的 运作.
38 19 IC 内部的 连接.
必须 是 left 打开 为 正常的 运作.
39 20 RxDLCLK receive 数据 link 时钟 (输出)
. 一个 gapped 时钟 信号 获得 从 一个 2.048 mbit/s
时钟, 有 为 一个 外部 设备 至 时钟 在 rxdl 数据 (在 4, 8, 12, 16 或者 20 khz) 在
这 rising 边缘.
40 21 RxDL receive 数据 link (输出)
. 一个 2.048 mbit/s 数据 stream containing received 线条 数据
之后 hdb3 解码. 这个 数据 是 clocked 输出 和 这 rising 边缘 的 e2o.
41 22 TxMF transmit multiframe boundary (输入)
. 一个 起作用的 低 输入 使用 至 设置 这 transmit
multiframe boundary (cas 或者 crc multiframe). 这 mt9075a 将 发生 它的 自己的
multiframe 如果 这个 管脚 是 使保持 高. 这个 输入 是 通常地 牵引的 高 为 大多数 产品.
42 23 RxMF receive multiframe boundary (输出).
一个 输出 脉冲波 delimiting 这 received
multiframe boundary. 这 next 框架 输出 在 这 数据 stream (dsto) 是 基本 框架
零 在 这 pcm 30 link. 这个 receive multiframe 信号 能 是 related 至 也 这
receive crc multiframe (页 01h, 地址 10h, 位 6, mfsel=1) 或者 这 receive
signalling multiframe (mfsel=0).
43 24 bs/LS 系统 总线 同步的/线条 同步的 选择 (输入)
. 如果 高, c4b 和 F0b
将 是 输入; 如果 低, c4b 和 f0b 将 是 输出.
44 32 E2o 2.048 mhz 提取 时钟 (输出).
这 时钟 提取 从 这 received 信号
和 使用 内部 至 时钟 在 数据 received 在 rtip 和 rring.
管脚 描述 (持续)
管脚 #
名字 描述
PLCC MQFP
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