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飞利浦 半导体 初步的 数据
PDI1394P232-端口/1-端口 400 mbps 物理的 layer 接口
2001 sep 06
4
4.2 lfbga 配置
SV01909
ABCDEFGH
1
2
3
4
5
6
7
8
bottom (球) 视图
球
信号 球 信号 球 信号 球 信号
A1 AGND C1 重置 E1 PLLGND G1 DGND
A2 TPBIAS1 C2 AV
DD
E2 XI G2 DGND
A3 TPA1– C3 AV
DD
E3 XO G3 CTL0
A4 R1 C4 TPB1+ E4 D2 G4 CTL1
A5 AGND C5 AV
DD
E5 CPS G5 D5
A6 TPBIAS0 C6 TPB0+ E6 DV
DD
G6 PD
A7 TPB0– C7 AV
DD
E7 PC1 G7 DGND
A8 AGND C8 TEST0 E8 ISO G8 DGND
B1 AGND D1 PLLV
DD
F1 DV
DD
H1 LREQ
B2 AGND D2 AV
DD
F2 DV
DD
H2 SYSCLK
B3 TPA1+ D3 PLLGND F3 CNA H3 D0
B4 TPB1– D4 PLLV
DD
F4 D4 H4 D1
B5 TPA0+ D5 R0 F5 D6 H5 D3
B6 TPA0– D6 桥 F6 c/lkon H6 D7
B7 AGND D7 TWOPORT F7 PC0 H7 LPS
B8 AV
DD
D8 DV
DD
F8 PC2 H8 DGND

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飞利浦半导体初步的数据 PDI1394P232-端口/1-端口 400 mbps 物理的 layer 接口 2001 sep 06 4 4.2 lfbga 配置 SV01909 ABCDEFGH 1 2 3 4 5 6 7 8 bottom (球) 视图球信号球信号球信号球信号 A1 AGND C1 重置 E1 PLLGND G1 DGND A2 TPBIAS1 C2 AV DD E2 XI G2 DGND A3 TPA1– C3 AV DD E3 XO G3 CTL0 A4 R1 C4 TPB1+ E4 D2 G4 CTL1 A5 AGND C5 AV DD E5 CPS G5 D5 A6 TPBIAS0 C6 TPB0+ E6 DV DD G6 PD A7 TPB0– C7 AV DD E7 PC1 G7 DGND A8 AGND C8 TEST0 E8 ISO G8 DGND B1 AGND D1 PLLV DD F1 DV DD H1 LREQ B2 AGND D2 AV DD F2 DV DD H2 SYSCLK B3 TPA1+ D3 PLLGND F3 CNA H3 D0 B4 TPB1– D4 PLLV DD F4 D4 H4 D1 B5 TPA0+ D5 R0 F5 D6 H5 D3 B6 TPA0– D6 桥 F6 c/lkon H6 D7 B7 AGND D7 TWOPORT F7 PC0 H7 LPS B8 AV DD D8 DV DD F8 PC2 H8 DGND

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