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飞利浦 半导体 初步的  规格
PDI1394P11A3-端口 物理的 layer 接口
1999 三月 10
8
14.0 交流 切换 特性
标识 参数 量过的 测试 情况
限制
UNITSYMBOL 参数 量过的 测试情况
最小值 典型值 最大值
单位
transmit jitter tpa, tpb
±
0.25 ns
transmit skew 在 tpa 和 tpb
±
0.15 ns
t
r
transmit 上升 时间 10% 至 90% R
L
= 56
Ω
, c
L
= 10 pf 2.2 ns
t
f
transmit 下降 时间 90% 至 10% R
L
= 56
Ω
, c
L
= 10 pf 2.2 ns
t
su
dn, ctln, lreq 输入 建制 时间
至 sysclk
50% 至 50% 看 图示 1 5 ns
t
H
dn, ctln, lreq 输入 支撑 时间
从 sysclk
50% 至 50% 看 图示 1 2 ns
t
D
延迟 时间, sysclk 至 dn, ctln 50% 至 50% 看 图示 2 2 13 ns
15.0 切换 波形
SV00238
50% 50%
50%
t
SU
t
H
SYSCLK
dn, ctln, lreq
图示 1. dn, ctln, lreq 输入 建制 和 支撑 时间
SV00239
50%
t
D
SYSCLK
dn, ctln
50%
图示 2. dn, ctln, 输出 延迟 相关的 至 sysclk

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飞利浦半导体初步的规格 PDI1394P11A3-端口物理的 layer 接口 1999 三月 10 8 14.0 交流切换特性标识参数量过的测试情况限制 UNITSYMBOL 参数量过的测试情况最小值典型值最大值单位 transmit jitter tpa, tpb ± 0.25 ns transmit skew 在 tpa 和 tpb ± 0.15 ns t r transmit 上升时间 10% 至 90% R L = 56 Ω , c L = 10 pf 2.2 ns t f transmit 下降时间 90% 至 10% R L = 56 Ω , c L = 10 pf 2.2 ns t su dn, ctln, lreq 输入建制时间至 sysclk 50% 至 50% 看图示 1 5 ns t H dn, ctln, lreq 输入支撑时间从 sysclk 50% 至 50% 看图示 1 2 ns t D 延迟时间, sysclk 至 dn, ctln 50% 至 50% 看图示 2 2 13 ns 15.0 切换波形 SV00238 50% 50% 50% t SU t H SYSCLK dn, ctln, lreq 图示 1. dn, ctln, lreq 输入建制和支撑时间 SV00239 50% t D SYSCLK dn, ctln 50% 图示 2. dn, ctln, 输出延迟相关的至 sysclk

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