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资料编号:550793
 
资料名称:PLL1708DBQ
 
文件大小: 171.48K
   
说明
 
介绍:
3.3 V DUAL PLL MULTICLOCK GENERATOR
 
 


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
SLES065
12月 2002
www.德州仪器.com
12
SCKO0
150 ns
SCKO1
SCKO2
SCKO3
fs2, 1
稳固的 时钟 转变 区域 稳固的
33.8688 mhz
SR
CSEL
50 ns
图示 11. scko 瞬时 定时
电源-在 重置
这 pll1707/8 有 一个 内部的 电源-在 重置 电路. 这 模式 寄存器 的 这 pll1708 是 initialized 和 default settings
用 电源-在 重置. 全部地 这 重置 时期, 所有 时钟 输出 是 使能 和 这 default settings 之后 电源-向上 time.
initialization 用 内部的 电源-在 重置 是 完毕 automatically 在 1024 主控 clocks 在 v
DD
> 2.0 v (典型值). 电源-在
重置 定时 是 显示 在 图示 12.
重置 重置除去
1024 主控 clocks
V
DD
2.4 v
2.0 v
1.6 v
内部的 重置
主控 时钟
图示 12. 电源-在 重置 定时
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