PLL1705
PLL1706
SLES046A
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8月 2002
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修订 九月 2002
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14
fs1 (md)
16
15
14
13
12
11
5
6
7
8
9
10
pll1705/6
fs2 (mc)
sr(ml)
V
CC
AGND
XT1
DGND2
MCKO2
MCKO1
V
DD
2
CSEL
XT2
V
DD
1
1
2
3
4
SCKO2
SCKO3
DGND1
20
19
18
17
V
DD
3
SCKO0
SCKO1
DGND3
3.3 v
(1)
(1)
(2)
(4)
(3) (3)
(1)
(2)
时钟 输出 (5)
(1)
(1)
0.1-
µ
f 陶瓷的 电容 典型, 取决于 在 质量 的 电源 供应 和 模式 布局
(2)
10-
µ
f 铝 electrolytic 电容 典型, 取决于 在 质量 的 电源 供应 和 模式 布局
(3)
27-mhz quartz 结晶 和 10
–
33 pf
×
2 陶瓷的 电容, 这个 发生 这 适合的 振幅 的 振动 在 xt1/xt2
(4)
这个 连接 是 为 pll1705 (并行的 模式); 当 pll1706 (串行 模式) 是 至 是 used, 控制 管脚 必须 是 连接 至 串行 连接
控制.
(5)
为 好的 jitter 效能, 降低 这 加载 电容 在 这 时钟 输出.
图示 14. 典型 连接 图解
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