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资料编号:701173
 
资料名称:W195B
 
文件大小: 141.3K
   
说明
 
介绍:
Frequency Generator for Integrated Core Logic
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
W195B
初步的
11
交流 电的 特性
T
一个
°
c 至 +70
°
c, v
DDQ3
= 3.3v±5%, v
DDQ2
= 2.5v±5%
f
XTL
= 14.31818 mhz
展开 spectrum 函数 转变 止
注释:
10. 时期, jitter, 补偿, 和 skew 量过的 在 rising 边缘 在 1.25 为 2.5v clocks 和 在 1.5v 为 3.3v clocks.
11. T
是 量过的 在 2.0v 为 2.5v 输出, 2.4v 为 3.3v outputs.
12. T
是 量过的 在 0.4v 为 所有 输出.
13. 这 时间 指定 是 量过的 从 当 v
DDQ3
achieves 它的 名义上的 运行 水平的 (典型 情况 v
DDQ3
= 3.3v) 直到 这 频率 输出 是 稳固的 和
运行 在里面 规格.
14. T
上升
和 t
下降
是 量过的 作 一个 转变 通过 这 门槛 区域 v
ol
= 0.4v 和 v
oh
= 2.0v (1 毫安) 电子元件工业联合会 规格.
参数 描述
66.6-mhz host 100-mhz host
单位 注释最小值 最大值 最小值 最大值
T
iod
host/cpuclk 时期 15.0 15.5 10.0 10.5 ns 10
T
host/cpuclk 高 时间 5.2 n/一个 3.0 n/一个 ns 13
T
host/cpuclk 低 时间 5.0 n/一个 2.8 n/一个 ns 14
T
上升
host/cpuclk 上升 时间 0.4 1.6 0.4 1.6 ns
T
FALL
T
iod
sdram clk 时期 10.0 10.5 10.0 10.5 ns 10
T
sdram clk 高 时间 3.0 n/一个 3.0 n/一个 ns 13
T
sdram clk 低 时间 2.8 n/一个 2.8 n/一个 ns 14
T
上升
sdram clk 上升 时间 0.4 1.6 0.4 1.6 ns
T
FALL
sdram clk 下降 时间 0.4 1.6 0.4 1.6 ns
T
iod
apic clk 时期 60.0 64.0 60.0 64.0 ns 10
T
apic clk 高 时间 25.5 n/一个 25.5 n/一个 ns 13
T
apic clk 低 时间 25.3 n/一个 25.3 n/一个 ns 14
T
上升
apic clk 上升 时间 0.4 1.6 0.4 1.6 ns
T
FALL
apic clk 下降 时间 0.4 1.6 0.4 1.6 ns
T
iod
3v66 clk 时期 15.0 16.0 15.0 16.0 ns 10, 12
T
3v66 clk 高 时间 5.25 n/一个 5.25 n/一个 ns 13
T
3v66 clk 低 时间 5.05 n/一个 5.05 n/一个 ns 14
T
上升
3v66 clk 上升 时间 0.5 2.0 0.5 2.0 ns
T
FALL
3v66 clk 下降 时间 0.5 2.0 0.5 2.0 ns
T
iod
pci clk 时期 30.0 n/一个 30.0 n/一个 ns 10, 11
T
pci clk 高 时间 12.0 n/一个 12.0 n/一个 ns 13
T
pci clk 低 时间 12.0 n/一个 12.0 n/一个 ns 14
T
上升
pci clk 上升 时间 0.5 2.0 0.5 2.0 ns
T
FALL
pci clk 下降 时间 0.5 2.0 0.5 2.0 ns
tp
ZL
, tp
ZH
输出 使能 延迟 (所有 输出) 1.0 10.0 1.0 10.0 ns
tp
LZ
, tp
ZH
输出 使不能运转 延迟 (所有 输出) 1.0 10.0 1.0 10.0 ns
t
稳固的
所有 时钟 stabilization 从 电源-向上 3 3 ms
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