54F175DM_集成电路资料查询网

单位 LoadingFan 输出
54F74F
管脚 Names 描述
UL 输入 I
IH
I
IL
HIGHLOW 输出 I
OH
I
OL
D
0
–D
3
数据 输入 1010 20
m
A
b
06 毫安
CP 时钟 脉冲波 输入 (起作用的 Rising 边缘) 1010 20
m
A
b
06 毫安
MR
主控 重置 输入 (起作用的 低) 1010 20
m
A
b
06 毫安
Q
0
–Q
3
真实 输出 50333
b
1 mA20 毫安
Q
0
–Q
3
Complement 输出 50333
b
1 mA20 毫安
函数的 描述
这 ’F175 组成 的 四 边缘-triggered D flip-flops 和
单独的 D 输入 和 Q 和 Q
outputs 这 时钟 和
主控 重置 是 common 这 四 flip-flops 将 store 这
状态 的 它们的 单独的 D 输入 在 这 低-至-高 时钟
(cp) transition 造成 单独的 Q 和 Q
输出 至 follow
一个 低 输入 在 这 主控 重置 (mr
) 将 强迫 所有 Q 输出-
puts 低 和 Q
输出 高 独立 的 时钟 或者
数据 inputs 这 ’F175 是 有用的 为 一般 逻辑 applica-
tions 在哪里 一个 一般 主控 重置 和 时钟 是 接受-
able
真实 表格
输入 输出
MR CP D
n
Q
n
Q
n
LXXLH
H
L
HHL
H
L
LLH
H
e
高 电压 水平的
L
e
低 电压 水平的
X
e
不重要
L
e
低-至-高 时钟 转变
逻辑 图解
TLF9490–4
请 便条 那 这个 图解 是 提供 仅有的 为 这 understanding 的 逻辑 行动 和 应当 不 是 使用 至 估计 传播 delays
2

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单位 LoadingFan 输出 54F74F 管脚 Names 描述 UL 输入 I IH I IL HIGHLOW 输出 I OH I OL D 0 –D 3 数据输入 1010 20 m A b 06 毫安 CP 时钟脉冲波输入 (起作用的 Rising 边缘) 1010 20 m A b 06 毫安 MR 主控重置输入 (起作用的低) 1010 20 m A b 06 毫安 Q 0 –Q 3 真实输出 50333 b 1 mA20 毫安 Q 0 –Q 3 Complement 输出 50333 b 1 mA20 毫安函数的描述这 ’F175 组成的四边缘-triggered D flip-flops 和单独的 D 输入和 Q 和 Q outputs 这时钟和主控重置是 common 这四 flip-flops 将 store 这状态的它们的单独的 D 输入在这低-至-高时钟 (cp) transition 造成单独的 Q 和 Q 输出至 follow 一个低输入在这主控重置 (mr ) 将强迫所有 Q 输出- puts 低和 Q 输出高独立的时钟或者数据 inputs 这 ’F175 是有用的为一般逻辑 applica- tions 在哪里一个一般主控重置和时钟是接受- able 真实表格输入输出 MR CP D n Q n Q n LXXLH H L HHL H L LLH H e 高电压水平的 L e 低电压水平的 X e 不重要 L e 低-至-高时钟转变逻辑图解 TLF9490–4 请便条那这个图解是提供仅有的为这 understanding 的逻辑行动和应当不是使用至估计传播 delays 2

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