W83194R-39A_集成电路资料查询网

w83194r-39/-39a
初步的
发行 释放 日期: 将 1998
-3-  修订 0.20
4.0  管脚 配置
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Vddq1
pci_stop#/ref0
Vss
Xin
Xout
Vddq2
pciclk_f/mode*
pciclk0/fs3*
Vss
PCICLK1
PCICLK2
PCICLK3
PCICLK4
Vddq2
缓存区 在
Vss
SDRAM11
SDRAM10
Vddq3
sdram 9
sdram 8
Vss
SDATA
SDCLK
VddL1
IOAPIC
ref1/fs2*
Vss
cpuclk_f
CPUCLK1
VddL2
cpu_stop#
SDRAM12
Vss
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sdram 1
sdram 2
Vddq3
sdram 3
Vss
sdram 4
sdram 5
sdram 6
sdram 7
Vddq4
Vddq3
48mhz/fs0*
24mhz/fs1*
(w83194r-39a )
5.0  管脚 描述
在 - 输入
输出 - 输出
i/o - bi-directional 管脚
# - 起作用的 低
* -  内部的 250k
Ω
拉-向上

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w83194r-39/-39a 初步的发行释放日期: 将 1998 -3- 修订 0.20 4.0 管脚配置 48 47 46 45 44 43 42 41 40 39 38 37 36 35 34 33 32 31 30 29 28 27 26 25 1 2 3 4 5 6 7 8 9 10 11 12 13 14 15 16 17 18 19 20 21 22 23 24 Vddq1 pci_stop#/ref0 Vss Xin Xout Vddq2 pciclk_f/mode* pciclk0/fs3* Vss PCICLK1 PCICLK2 PCICLK3 PCICLK4 Vddq2 缓存区在 Vss SDRAM11 SDRAM10 Vddq3 sdram 9 sdram 8 Vss SDATA SDCLK VddL1 IOAPIC ref1/fs2* Vss cpuclk_f CPUCLK1 VddL2 cpu_stop# SDRAM12 Vss sdram 0 sdram 1 sdram 2 Vddq3 sdram 3 Vss sdram 4 sdram 5 sdram 6 sdram 7 Vddq4 Vddq3 48mhz/fs0* 24mhz/fs1* (w83194r-39a ) 5.0 管脚描述在 - 输入输出 - 输出 i/o - bi-directional 管脚 # - 起作用的低 * - 内部的 250k Ω 拉-向上

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