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资料编号:706072
 
资料名称:W9816G6BB
 
文件大小: 1164.04K
   
说明
 
介绍:
512K x 2 BANKS x 16 BITS SDRAM
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
W9816G6BB
发行 释放 日期: january 2, 2003
- 5 - 修订 a1
5. 球 描述
球-location
名字
函数 描述
n6, p7, p6, r6,
r2, p2, p1, n2,
n1, m2, n7
A0
A10
地址
多路复用 管脚 为 行 和 column 地址.
行 地址: a0
a10. column 地址: a0
a7.
m1 ba
Bank
地址
选择 bank 至 活动 在 行 地址 获得
时间, 或者 bank 至 读/写 在 column 地址
获得 时间.
a6, b7, c7, d7, d6,
e7, f7, g7, g1, f1,
e1, d2, d1, c1, b1,
a2,
DQ0
DQ15
数据 输入/
输出
多路复用 管脚 为 数据 输入 和 输出.
L7
CS
碎片 选择
使不能运转 或者 使能 这 command 解码器. 当
command 解码器 是 无能, 新 command 是
ignored 和 previous 运作 持续.
K6
RAS
行 地址
Strobe
这 时钟,
RAS
,
CAS
我们
定义 这
运作 至 是 executed.
K7
CAS
Column
地址
Strobe
涉及 至
RAS
J7
我们
写 使能
涉及 至
RAS
j2/j6
udqm/
LDQM
输入/输出
掩饰
这 输出 缓存区 是 放置 在 hi-z (和 latency 的 2)
运作 和 零 latency.
k2 clk 时钟 输入
系统 时钟 使用 至 样本 输入 在 这 rising
边缘 的 时钟.
l1 cke 时钟 使能
cke 控制 这 时钟 触发 和 deactivation.
当 cke 是 低, 电源 向下 模式, suspend
模式, 或者 自 refresh 模式 是 entered.
a7, r7 V
DD
电源
(+3.3v)
电源 为 输入 缓存区 和 逻辑 电路 inside
dram.
a1, r1 V
SS
地面
地面 为 输入 缓存区 和 逻辑 电路 inside
dram.
b6, c2, e6, f2 V
DDQ
电源
(+3.3v) 为
i/o 缓存区
separated 电源 从 v
DD
, 使用 为 输出 缓存区
至 改进 噪音 免除.
b2, c6, e2, f6 V
SSQ
地面 为
i/o 缓存区
SS
, 使用 为 输出 缓存区
至 改进 噪音 免除.
g2, g6, h1, h2, h6,
h7, j1, k1, l2, l6,
m6, m7
NC
连接
非 连接
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