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资料编号:780228
 
资料名称:TLC1543IN
 
文件大小: 424K
   
说明
 
介绍:
10-BIT ANALOG-TO-DIGITAL CONVERTERS WITH SERIAL CONTROL AND 11 ANALOG INPUTS
 
 


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本平台电子爱好着纯手工中文简译:截至2020/5/17日,支持英文词汇500个
tlc1542c, tlc1542i, tlc1542m, tlc1542q, tlc1543c, tlc1543i, tlc1543q
10-位 相似物-至-数字的 转换器 和
串行 控制 和 11 相似物 输入
slas052e – march 1992 – october 1998
15
邮递 办公室 盒 655303
达拉斯市, 德州 75265
参数 度量 信息
定时 图解 (持续)
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进入 循环 b
变换 在 新 多路调制器 地址;
同时发生地 变换 输出 previous
转换 值
样本 循环 b
一个/d 转换
间隔
Initialize
MSB LSB
previous 转换 数据
MSB LSB
B3 B2 B1 B0 C3
B9A9 A8 A7 A6 A5 A4 A3 A2 A1 A0
12345678910 1
i/o
时钟
数据
输出
地址
CS
EOC
Initialize
ÏÏÏ
ÏÏÏ
ÏÏÏ
ÎÎ
ÎÎ
ÎÎÎ
水平的
hi-z
看 便条 b
11 16
(看 便条 一个)
注释: 一个. 至 降低 errors 造成 用 噪音 在 cs
, 这 内部的 电路系统 waits 为 一个 建制 时间 加 二 下落 edges 的 这 内部的 系统
时钟 之后 cs
在之前 responding 至 控制 输入 信号. 因此, 非 attempt 应当 是 制造 至 时钟 在 一个 地址 直到 这
最小 cs
建制 时间 有 消逝.
b. 一个 低-至-高 转变 的 cs
使不能运转 地址 和 这 i/o 时钟 在里面 一个 最大 的 一个 建制 时间 加 二 下落 edges 的
这 内部的 系统 时钟.
图示 11. 定时 为 11- 至 16-时钟 转移 使用 cs(串行 转移 间隔 shorter 比 转换)
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