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资料编号:820027
 
资料名称:DS90CF364AMTD
 
文件大小: 307K
   
说明
 
介绍:
+3.3V LVDS Receiver 24-Bit Flat Panel Display (FPD) LinkΑ65 MHz, +3.3V LVDS Receiver 18-Bit Flat Panel Display (FPD) LinkΑ65 MHz
 
 


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http://www.国家的.com
ds90cf384a/ds90cf364a
( )
便条 1:
便条 2:
(典型值) V
CC
3.3v T
一个
25
便条 3:
V
OD
V
OD
便条 4:
DS90C383A
(tppos 最小值 最大值) / ( rspos)
RSKM LVDS isi( )
(250ps )
交流
图示 1. “worst 情况 测试 模式
标识 参数 最小值 典型值 最大值 单位
CLHT cmos/ttl 低-至-高 转变 时间 (图示 4) 2 5 ns
CHLT cmos/ttl 高-至-低 转变 时间 (图示 4) 1.8 5 ns
RSPos0 接受者 输入 strobe 位置 为 位 0 (图示 11, 12) f 65 mhz 0.7 1.1 1.4 ns
RSPos1 接受者 输入 strobe 位置 为 位 1 2.9 3.3 3.6 ns
RSPos2 接受者 输入 strobe 位置 为 位 2 5.1 5.5 5.8 ns
RSPos3 接受者 输入 strobe 位置 为 位 3 7.3 7.7 8.0 ns
RSPos4 接受者 输入 strobe 位置 为 位 4 9.5 9.9 10.2 ns
RSPos5 接受者 输入 strobe 位置 为 位 5 11.7 12.1 12.4 ns
RSPos6 接受者 输入 strobe 位置 为 位 6 13.9 14.3 14.6 ns
RSKM rxin skew 余裕 (便条 4) (图示 13) f 65 mhz 400 ps
RCOP rxclk 输出 时期 (图示 5) 15 T 50 ns
RCOH rxclk 输出 高 时间 (图示 5) f 65 mhz 5.0 7.6 9.0 ns
RCOL rxclk 输出 低 时间 (图示 5) 5.0 6.3 9.0 ns
RSRC rxout 建制 至 rxclk 输出 (图示 5) 4.5 7.3 ns
RHRC rxout 支撑 至 rxclk 输出 (图示 5) 4.0 6.3 ns
RCCD rxclk 在 至 rxclk 输出 延迟 25 , v
CC
3.3v (图示 6) 3.5 5.0 7.5 ns
RPLLS 接受者 阶段 锁 循环 设置 (图示 7) 10 ms
RPDD 接受者 电源 向下 延迟 (图示 10) 1 s
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